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1. 发明授权

CN114520703B 用于工业网络设备间时间同步的时钟漂移补偿方法及电路有权
公开(公告)号：CN114520703B
公开(公告)日：2023-12-29
申请号：CN202011303374.2
申请日：2020-11-19
申请人：中国科学院沈阳自动化研究所
发明人：王剑 , 谢闯 , 杨志家 , 段茂强 , 赵纯
IPC分类号： H04J3/06
摘要：增加了该方法的适用范围。本发明涉及用于工业网络设备间时间同步的时钟漂移补偿方法及电路。第一步，主时钟设备周期发送带有系统时间的数据帧，同步设备收到该数据帧后，提取出系统时间，并记录收到数据帧时刻的本地时间和本地时钟的计数值；第二步，在Tn时刻，判断同步周期n‑1内的时钟周期数的值是否大于门限值；若大于门限值，则转至第三步；否则，直接将时间偏差补偿到本地时间内，之后转至第四步；第三步，同时进行时间偏差补偿和频率偏差补偿；第四步，在Tn+1时刻，重复执行第一～三步，使时钟漂移补偿连续的周期执(56)对比文件谢闯，杨志家，王剑.一种面向WIA-PA系统级芯片的低功耗优化策略《.信息与控制》.2018,第47卷(第6期),全文.薛一飞《.基于IEEE802.1AS的时钟同步系统设计》《.中国优秀硕士学位论文全文数据库工程科技Ⅱ辑》.2020,全文.黄威然，楼佩煌，钱晓明《.基于实时以太网的网络化数控系统高精度时钟同步和短周期通信》《.计算机集成制造系统》.2015,第21卷(第10期),全文.Demirci, KS；Seo, JH；Truax, S；Beardslee, LA ；Luzinova, Y；Mizaikoff, B；Brand, O .FREQUENCY DRIFT COMPENSATION INMASS-SENSITIVE CHEMICAL SENSORS BASED ONPERIODIC STIFFNESS MODULATION.《Clarivate》.2009,全文.Mridula Verma;Shruti Asmita;K. K.Shukla.A Regularized Ensemble ofClassifiers for Sensor DriftCompensation《.IEEE》.2015,第16卷(第5期),全文.

2. 发明授权

CN113162778B 一种用于高速工业以太网主站冗余的方法有权
公开(公告)号：CN113162778B
公开(公告)日：2023-09-19
申请号：CN202010012216.5
申请日：2020-01-07
申请人：中国科学院沈阳自动化研究所
发明人：刘志峰 , 王建军 , 杨志家 , 谢闯 , 段茂强 , 程贺
IPC分类号： H04L41/0668 , H04L41/0823 , H04J3/06
摘要：本发明涉及一种用于高速工业以太网主站冗余的方法，包括：当活动主站AMN工作时，冗余主站SMN作为活动主站AMN的从站，并与活动主站AMN进行同步周期通信、监听网络；当活动主站AMN掉线后，按照冗余主站SMN的优先级转变为活动主站AMN并接管网络。本发明是在高速工业以太网标准主站基础上，实现具有冗余功能的主站。冗余结构具有热插拔，支持多个冗余节点，切换速度快，性能稳定的特点。在工业过程控制，运动控制等领域，保证了网络运行的健壮性和稳定性。

3. 发明公开

CN116346525A 基于MODBUS的功能安全实现方法审中-实审
公开(公告)号：CN116346525A
公开(公告)日：2023-06-27
申请号：CN202111599421.7
申请日：2021-12-24
申请人：中国科学院沈阳自动化研究所
发明人：杨志家 , 王建军 , 段茂强 , 刘志峰 , 董策 , 谢闯 , 崔书平 , 赵纯
IPC分类号： H04L12/40 , H04L9/40
摘要：本发明涉及一种基于工业通信协议MODBUS的功能安全实现方法，包含以下步骤：1.实现三种功能模块；2.将openSAFETY协议通过实现的功能模块融合于MODBUS通信协议中，在MODBUS上实现openSAFETY的功能安全应用。其中，功能块包括：安全校验模块；参数配置模块；对象字典映射模块。本发明针对现有技术中的不足，提供了基于MODBUS的openSAFETY功能安全实现方法，在数据应用层保证了数据的完整性和可靠性。

4. 发明公开

CN114520703A 用于工业网络设备间时间同步的时钟漂移补偿方法及电路有权
公开(公告)号：CN114520703A
公开(公告)日：2022-05-20
申请号：CN202011303374.2
申请日：2020-11-19
申请人：中国科学院沈阳自动化研究所
发明人：王剑 , 谢闯 , 杨志家 , 段茂强 , 赵纯
IPC分类号： H04J3/06
摘要：本发明涉及用于工业网络设备间时间同步的时钟漂移补偿方法及电路。第一步，主时钟设备周期发送带有系统时间的数据帧，同步设备收到该数据帧后，提取出系统时间，并记录收到数据帧时刻的本地时间和本地时钟的计数值；第二步，在Tn时刻，判断同步周期n‑1内的时钟周期数的值是否大于门限值；若大于门限值，则转至第三步；否则，直接将时间偏差补偿到本地时间内，之后转至第四步；第三步，同时进行时间偏差补偿和频率偏差补偿；第四步，在Tn+1时刻，重复执行第一～三步，使时钟漂移补偿连续的周期执行。采用时间偏差和频率偏差分离补偿的方式，并增加了快速补偿阶段，能够提高误差补偿的收敛速度，简化电路结构，降低对同步周期的要求，增加了该方法的适用范围。

5. 发明授权

CN102116840B 一种基于贪心策略的FPGA局部互联测试方法有权
公开(公告)号：CN102116840B
公开(公告)日：2012-12-05
申请号：CN200910248934.6
申请日：2009-12-30
申请人：中国科学院沈阳自动化研究所
发明人：杨志家 , 吕岩 , 马继开 , 谢闯 , 刘志峰 , 段茂强
IPC分类号： G01R31/3185 , G06F17/50
摘要：本发明公开一种基于贪心策略的FPGA局部互联测试方法，基于FPGA实际结构模型化，采用基于“影响因数”的贪心策略算法对这些连接关系进行分组，最终的分组结果反映到目标FPGA上即是一个完备的局部互联测试配置集。在进行分组的过程中，为了更加体现实用性，本发明还提供了可以根据目标器件的局部互联本身，或全局互联的结构特点进行分组条件约束的机制。本发明方法能够自动生成FPGA局部测试配置，且不依赖具体某一FPGA的结构，具有普适性，能够被广泛的推广；本发明采取了基于“影响因数”的贪心策略，实现了测试配置集的最小化和对局部互联资源的全覆盖；本发明充分考虑了FPGA器件本身的结构约束，确保生成的配置能够在实际器件中实现。

6. 发明公开

CN102116840A 一种基于贪心策略的FPGA局部互联测试方法有权
公开(公告)号：CN102116840A
公开(公告)日：2011-07-06
申请号：CN200910248934.6
申请日：2009-12-30
申请人：中国科学院沈阳自动化研究所
发明人：杨志家 , 吕岩 , 马继开 , 谢闯 , 刘志峰 , 段茂强
IPC分类号： G01R31/3185 , G06F17/50
摘要：本发明公开一种基于贪心策略的FPGA局部互联测试方法，基于FPGA实际结构模型化，采用基于“影响因数”的贪心策略算法对这些连接关系进行分组，最终的分组结果反映到目标FPGA上即是一个完备的局部互联测试配置集。在进行分组的过程中，为了更加体现实用性，本发明还提供了可以根据目标器件的局部互联本身，或全局互联的结构特点进行分组条件约束的机制。本发明方法能够自动生成FPGA局部测试配置，且不依赖具体某一FPGA的结构，具有普适性，能够被广泛的推广；本发明采取了基于“影响因数”的贪心策略，实现了测试配置集的最小化和对局部互联资源的全覆盖；本发明充分考虑了FPGA器件本身的结构约束，确保生成的配置能够在实际器件中实现。

7. 发明公开

CN1956021A 总线供电仪表的物理层媒体结合单元无效
公开(公告)号：CN1956021A
公开(公告)日：2007-05-02
申请号：CN200510047553.3
申请日：2005-10-26
申请人：中国科学院沈阳自动化研究所
发明人：吕岩 , 杨志家 , 崔书平 , 曹梦侠 , 谢闯 , 赵雪峰
IPC分类号： G08C19/00 , G08C19/16
摘要：本发明公开一种总线供电仪表的物理层媒体结合单元，安装在总线系统和数字系统之间，它由启动电路、信号接收电路和CD信号创建电路、功率调节电路和总线信号整形发送电路、发送信号基准电平电路组成，总线系统信号作为信号接收电路输入，信号接收电路输出送至数字系统；启动电路以总线信号为输入信号，分别与信号接收电路、CD信号创建电路、功率调节电路相连，为系统提供电源；功率调节电路接收总线整形发送电路信号，输出与总线系统相连；总线信号整形发送电路由发送信号基准电平电路提供阈值电平，输入控制信号由数字系统提供；CD信号创建电路输出信号至数字系统。本发明结构简单、可靠性高、总线信号交流特性优良、静态功耗小，效率高，性价比高。

8. 发明公开

CN116346580A 一种带冗余控制器的高速通信背板及其通信方法审中-实审
公开(公告)号：CN116346580A
公开(公告)日：2023-06-27
申请号：CN202111591345.5
申请日：2021-12-23
申请人：中国科学院沈阳自动化研究所
发明人：杨志家 , 焦平 , 谢闯 , 王剑 , 段茂强 , 董策 , 赵纯 , 崔书平
IPC分类号： H04L41/0663 , H04L12/40 , H04Q1/02
摘要：本发明涉及一种带冗余控制器的高速通信背板及其通信方法，所述背板通信上有主控制器卡1、主控制器卡2，多个IO板卡，带有多个高速连接器的通信背板。两个主控制器卡之间使用一个高速LVDS通信接口进行数据热备，实现主控制器卡冗余。主控制器卡和IO板卡通过两个高速MLVDS通信接口进行互联，实现背板通信总线冗余。本发明周期性通信时总线通信协议支持优化序列组合工作方式，高速设备和慢速设备经过合理配置每个IO板卡调度时间，减少通信空闲时间，提高总线数据交换速度。总线通信协议报文包括目的地址，源地址、类型、时间戳、状态位、数据长度、数据，CRC校验等内容。报文内容可用来进行身份校验，时间同步、状态监测、数据校验，确保背板通信数据安全性和可靠性。

9. 发明授权

CN105610745B 一种用于FSK信号的快速载波频偏估计及校正方法有权
公开(公告)号：CN105610745B
公开(公告)日：2018-11-27
申请号：CN201410686680.7
申请日：2014-11-25
申请人：中国科学院沈阳自动化研究所
发明人：段茂强 , 杨志家 , 王剑 , 董策 , 谢闯
IPC分类号： H04L25/02
摘要：本发明涉及一种用于FSK信号的快速载波频偏估计及校正的方法。该方法通过输入经过射频模块产生的低中频I/Q两路信号，与DDS产生的信号进行相关运算及滤波处理，再进行均值运算，在事先存入的均值‑频偏查找表中进行对应查询即可对频率偏差估计估计值，再把这个值反馈给前面的DDS就可以进行频偏消除完成频偏校正过程。本发明载波频偏估计速度快，在进行频偏校正后可以提高接收机的整体性能。

10. 发明授权

CN105527884B 支持多通信序列自动构建的WIA-PA通信序列控制器有权
公开(公告)号：CN105527884B
公开(公告)日：2018-07-31
申请号：CN201410566359.5
申请日：2014-10-22
申请人：中国科学院沈阳自动化研究所
发明人：王剑 , 杨志家 , 谢闯 , 董策 , 段茂强
IPC分类号： G05B19/042
摘要：本发明涉及支持多通信序列自动构建的WIA‑PA通信序列控制器,包括顺序连接的译码电路、状态机和定时器组;译码电路,用于接收处理器发来的定义通信序列类型的操作码,并将操作码解析成通信请求信号发送给状态机;状态机,用于根据通信请求信号控制定时器组中的定时器以及接收机、发送机和物理射频电路的开启和关闭,并按照当前通信序列的要求完成数据的收发,控制通信流程的执行;与发送机、接收机、物理射频电路连接;定时器组,用于通信序列中各时间参数进行定时,接收状态机的定时使能信号,生成定时溢出指示信号至状态机。本发明采用通信序列控制器取代处理器对整个通信流程进行控制,能够提高通信的实时性,降低处理器的工作负载。

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