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1. 发明授权

CN1057177C 采用高速数字频差计数器的同步电路失效
公开(公告)号：CN1057177C
公开(公告)日：2000-10-04
申请号：CN94116583.3
申请日：1994-09-27
申请人：美国电报电话公司
发明人：詹姆森·罗伯特·博托林尼
IPC分类号： H03L7/10
CPC分类号： H03L7/085 , G01R23/005 , H03D13/001
摘要：一种简化的测量设备，它能使任何两个频率源相互进行精确和定量的比较。利用它可以在振荡器用于运行中的系统时，用外来基准信号实现振荡器的校准。它能设置在时基单元内，在相对短的时间进行重复校准。基于环形计数器的频差检测器和电信转换系统中现有的控制器把精确的外部基准信号与时基单元的振荡器进行比较以进行实地校准。此外，由于它是全数字的，因此不需要进行设备的调谐。

2. 发明公开

CN108073806A 一种检测时钟频率的方法及装置有权
公开(公告)号：CN108073806A
公开(公告)日：2018-05-25
申请号：CN201611024608.3
申请日：2016-11-15
申请人：华为技术有限公司
发明人：苏琦 , 鹿甲寅 , 刘宇
IPC分类号： G06F21/55 , G06F21/71
CPC分类号： G06F21/552 , G01R23/10 , G06F1/04 , G06F11/0754 , H03D13/001 , H03L7/195
摘要：本发明实施例公开了一种检测时钟频率的方法及装置，方法包括：将已知的系统内部时钟频率范围划分为n个频率区间，每个频率区间对应一个频率检测模块，其中，n为大于或等于2的整数；获取系统当前的内部时钟频率，作为基准时钟频率；根据所述基准时钟频率选择频率区间对应的频率检测模块；通过选择的频率检测模块，根据所述基准时钟频率的频偏范围对被检测时钟进行检测。采用本发明，可降低系统内部时钟被攻击的风险，提升系统的安全性。

3. 发明公开

CN1104818A 采用高速数字频差计数器的同步电路失效
公开(公告)号：CN1104818A
公开(公告)日：1995-07-05
申请号：CN94116583.3
申请日：1994-09-27
申请人：美国电报电话公司
发明人：詹姆森·罗伯特·博托林尼
IPC分类号： H03L7/00
CPC分类号： H03L7/085 , G01R23/005 , H03D13/001
摘要：一种简化的测量设备，它能使任何两个频率源相互进行精确和定量的比较。利用它可以在振荡器用于运行中的系统时，用外来基准信号实现振荡器的校准。它能设置在时基单元内，在相对短的时间内进行重复校准。基于环形计数器的频差检测器和电信转换系统中现有的控制器把精确的外部基准信号与时基单元的振荡器进行比较以进行实地校准。此外，由于它是全数字的，因此不需要进行设备的调谐。

4. 发明专利

JPS60191504A Phase difference output device 失效
标题翻译：相差输出装置
公开(公告)号：JPS60191504A
公开(公告)日：1985-09-30
申请号：JP4798484
申请日：1984-03-13
申请人： Toshiba Corp
发明人： IKOMA KUNITOSHI
IPC分类号： H02P29/00 , H03D13/00
CPC分类号： H03D13/001
摘要： PURPOSE:To obtain easily an output signal of a desired and optional characteristic by detecting a phase difference between two signals and processing an error signal digitally. CONSTITUTION:A counter 11 counts a clock signal CL generated while an FF circuit 12 is set by a reference frequency signal FR and reset by a comparison frequency signal FO. An output of the counter 11 responds to a phase difference between the reference frequency signal FR and the comparison frequency signal FO. Then the output of the computer 11 is given to a data converter 13, which converts data based on a prescribed characteristic. After the phase error signal from the converter 13 is converted by a D-A converter 14, the signal is outputted as an analog signal via an LPF15. The output signal of a desired optional characteristic is obtained easily in this way.
摘要翻译：目的：通过检测两个信号之间的相位差并以数字方式处理误差信号，轻松获得所需和可选特性的输出信号。构成：计数器11对FF电路12由参考频率信号FR设置并由比较频率信号FO复位而产生的时钟信号CL进行计数。计数器11的输出响应参考频率信号FR和比较频率信号FO之间的相位差。然后，计算机11的输出被提供给数据转换器13，数据转换器13基于规定的特性转换数据。在来自转换器13的相位误差信号被D-A转换器14转换之后，该信号通过LPF15作为模拟信号输出。以这种方式容易地获得期望的可选特性的输出信号。

5. 发明专利

JPWO2008053562A1 位相差検出器、及び位相差検出方法有权
公开(公告)号：JPWO2008053562A1
公开(公告)日：2010-02-25
申请号：JP2008541974
申请日：2006-11-02
申请人：富士通株式会社
发明人：正純丸谷 , 正純丸谷
IPC分类号： H03K5/26 , G01R25/04 , H03D13/00
CPC分类号： G01R25/08 , H03D13/001 , H03K5/26
摘要：共に同じ第1の周波数を有する入力クロック間の位相差を検出する位相差検出器において、前記入力クロックに対して、前記入力クロック間の位相差をパルス幅で示された位相差信号に変換するパルス幅変換部と、前記第1の周波数より遅い第2の周波数を有する基準クロックを用いて前記位相差信号のレベルをサンプリングし、前記サンプリングされた位相差信号のレベルに応じた第1の重み付けにより、前記位相差信号のレベルの個数をカウントするカウンタ部とを備え、前記カウンタ部によるカウント値が一定の範囲内を推移するとき前記第1の重み付けにより前記入力クロック間の位相差が検出される。

6. 发明专利

JP3665512B2 Comparison device and pll circuit using the same binary signal 有权
公开(公告)号：JP3665512B2
公开(公告)日：2005-06-29
申请号：JP19760999
申请日：1999-07-12
申请人：株式会社東芝
发明人：彰安田
IPC分类号： G01R23/10 , G01R25/00 , H03D13/00 , H03K5/26 , H03L7/06 , H03L7/085
CPC分类号： H03D13/001

7. 发明申请

US20170146578A1 METHOD AND DEVICE FOR MEASURING THE FREQUENCY OF A SIGNAL 审中-公开
公开(公告)号：US20170146578A1
公开(公告)日：2017-05-25
申请号：US15139801
申请日：2016-04-27
申请人： STMICROELECTRONICS SA
发明人： Marc HOUDEBINE , Sebastien Dedieu
IPC分类号： G01R23/10
CPC分类号： G01R23/10 , G01R23/02 , H03D13/001
摘要： A method includes a) counting whole periods of a signal during a first period of a reference signal, b) repeating step a) for each period of the reference signal until a first duration is equal to a first quantity of periods of the reference signal, and c) determining a first average of the whole periods. The method also includes repeating at least one of steps a) to c) and at each repetition shifting a start of the counting of step a) by at least one period of the reference signal, and in steps b) and c) accounting for whole periods of the signal already counted during the at least one preceding group of steps a) and b). The method includes determining a second average of the first averages, and determining the frequency of the signal from the second average and the frequency of the reference signal.

8. 发明申请

US20090108879A1 PROGRAMMABLE SENSITIVITY FREQUENCY COINCIDENCE DETECTION CIRCUIT AND METHOD 失效
标题翻译：可编程灵敏度频率检测电路和方法
公开(公告)号：US20090108879A1
公开(公告)日：2009-04-30
申请号：US11928080
申请日：2007-10-30
申请人： Ram Kelkar , Grant P. Kesselring
发明人： Ram Kelkar , Grant P. Kesselring
IPC分类号： G01R23/15
CPC分类号： G01R23/005 , H03D13/001
摘要： A frequency coincidence detection circuit for detecting frequency edges for each of a plurality of periodic digital signals. The circuit generates count indicators for each of the periodic digital signals and compares each of the count indicators to a programmable sensitivity input to determine a coincidence window for the corresponding one of each of the periodic digital signals. The circuit determines a signal coincidence of the coincidence windows. In another embodiment, a frequency coincidence detection method is provided. The method detects frequency edges for each of a plurality of periodic digital signals, generates count indicators for each of the periodic digital signals and compares each of the count indicators to a programmable sensitivity input to determine a coincidence window for the corresponding one of each of the periodic digital signals. The method determines a signal coincidence of the coincidence windows.
摘要翻译：一种用于检测多个周期数字信号中的每一个的频率边缘的频率一致检测电路。电路产生每个周期性数字信号的计数指示器，并将每个计数指示器与可编程灵敏度输入进行比较，以确定每个周期性数字信号中的相应一个的一致窗口。电路确定符合窗口的信号重合。在另一个实施例中，提供了一种频率一致检测方法。该方法检测多个周期性数字信号中的每一个的频率边缘，为每个周期性数字信号产生计数指示符，并将每个计数指示符与可编程灵敏度输入进行比较，以确定每个周期数字信号中的每一个的相应窗口周期性数字信号。该方法确定符合窗口的信号重合。

9. 发明申请

US20040100308A1 Method and circuitry for phase align detection in multi-clock domain 有权
标题翻译：用于多时钟域中相位校准检测的方法和电路
公开(公告)号：US20040100308A1
公开(公告)日：2004-05-27
申请号：US10375587
申请日：2003-02-27
申请人： Sun Microsystems, Inc.
发明人： Massimo Sutera , David A. Bunsey JR. , Daniel Y. Cheung , Lan Lee , Kevin B. Normoyle , Sung-Hun Oh , Shi-Chin Ou-Yang , Fabrizio Romano , Ivana Cappellano
IPC分类号： H03D013/00
CPC分类号： H03D13/001
摘要： In an embodiment, present application describes a system and method to detect the alignment of multiple clocks in multi-clock domains system. In some variations, multiple clocks are derived from one or more reference clocks using various PLLs. The derived clocks maintain frequency relationship with the reference clock. In some variations, a relationship between the frequencies of various clocks is used to generate the alignment signals in the domain of one of the clocks.
摘要翻译：在一个实施例中，本申请描述了一种用于检测多时钟域系统中多个时钟的对准的系统和方法。在一些变型中，使用各种PLL从一个或多个参考时钟导出多个时钟。导出的时钟与参考时钟保持频率关系。在一些变型中，使用各种时钟的频率之间的关系来产生其中一个时钟的域中的对准信号。

10. 发明授权

US06735265B1 Comparator 失效
标题翻译：比较器
公开(公告)号：US06735265B1
公开(公告)日：2004-05-11
申请号：US09614208
申请日：2000-07-11
申请人： Akira Yasuda
发明人： Akira Yasuda
IPC分类号： H03D324
CPC分类号： H03D13/001
摘要： A comparator compares a first binary input signal and a second binary input signal each binalized. A generator generates a reset signal at each rising edge or each falling edge of the first input signal. A counter counts the second input signal at each timing determined by the reset signal. The counted value represents a ratio of each frequency of the first input signal and the second input signal. A subtractor calculates a difference between the counted value and a set value representing a predetermined ratio of each frequency of the first input signal and the second input signal. An integrator integrates the difference. The integrated value represents a phase difference of the frequencies of the first input signal and the second input signal.
摘要翻译：比较器比较第一二进制输入信号和每个二进制的第二二进制输入信号。发生器在第一输入信号的每个上升沿或每个下降沿产生复位信号。计数器在由复位信号确定的每个定时对第二输入信号进行计数。计数值表示第一输入信号和第二输入信号的每个频率的比率。减法器计算计数值和表示第一输入信号和第二输入信号的每个频率的预定比率的设定值之间的差。集成商整合差异。积分值表示第一输入信号和第二输入信号的频率的相位差。

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