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    • 1. 发明申请
      US20060098156A1 Optical calibration system and method 有权
    • Optical calibration system and method
    • 光学校准系统及方法
    • US20060098156A1
    • 2006-05-11
    • US10984594
    • 2004-11-08
    • Steven Frisken , Glenn Baxter , Hao Zhou , Dmitri Abakoumov
    • Steven Frisken , Glenn Baxter , Hao Zhou , Dmitri Abakoumov
    • G02F1/13
    • G01M11/0292 , G02B6/29311 , G02B6/29313 , G02F2203/12 , G02F2203/50
    • In an optical system including an optical input port for projecting an input optical signal onto an optical phased matrix array, an optical phased matrix array including a plurality of individually addressable pixels thereon, each said pixel being drivable within a prescribed range of levels, and an optical output port for collecting a predetermined fraction of said optical signal received from said optical phased matrix array; a method of compensating for phase distortions including the steps of: (a) determining a plurality of transfer functions relating said level of each said pixel to the phase variation each said pixel introduces to light from said input optical signal which is incident thereon; and (b) controlling the level of selected ones of said pixels in accordance with a corresponding transfer function such that said fractional signal received at said output port is modified in phase to substantially compensate for optical phase distortions arising from said optical phased matrix array.
    • 在包括用于将输入光信号投影到光相位矩阵阵列上的光输入端口的光学系统中，包括多个可单独寻址的像素的光相位矩阵阵列，每个所述像素可在规定的电平范围内驱动，并且 光输出端口，用于收集从所述光相位矩阵阵列接收的所述光信号的预定分数; 一种补偿相位失真的方法，包括以下步骤：（a）确定将每个所述像素的所述电平与所述像素引入的相位变化相关联的多个传输函数，所述相位变化来自入射在其上的所述输入光信号; 以及（b）根据相应的传递函数来控制所述像素中所选择的像素的电平，使得在所述输出端口处接收到的所述分数信号被相位修改以基本上补偿由所述光相位矩阵阵列产生的光学相位失真。
    • 基本信息 添加关注 加入工作空间 PDF全文 PDF下载 全文下载 相似专利 双屏查看 权利要求书 说明书全文 Global Dossier Espacenet 法律信息 同族专利 专利引用
    • 4. 发明申请
      US20070255886A1 Programmable logic device including programmable interface core and central processing unit 有权
    • Programmable logic device including programmable interface core and central processing unit
    • 可编程逻辑器件包括可编程接口核心和中央处理器
    • US20070255886A1
    • 2007-11-01
    • US11452859
    • 2006-06-14
    • Khang Dao , Glenn Baxter
    • Khang Dao , Glenn Baxter
    • G06F13/00
    • G06F15/7867
    • A programmable logic device (PLD) includes a central processing unit (CPU) and a programmable interface coupled to the CPU, wherein the programmable interface includes a core designated by a user. The programmable interface core allows devices, both on and off-chip, to communicate with the CPU. In one embodiment, the programmable interface core includes a crosspoint switch for coupling a plurality of devices and the CPU. Re-programmability of the PLD provides significant flexibility in providing features that can be parameterized based on the user's needs and/or associated design. Specifically, these parameterized features can be implemented in programmable resources on the PLD, thereby allowing these features to be modified at any time. Moreover, only those resources actually needed for the programmable interface core need be implemented, thereby allowing the user to optimize use of the remainder of the PLD. Finally, the functions of the processor local bus can be efficiently limited, thereby allowing the PLD to approach the performance level of an ASIC.
    • 可编程逻辑器件（PLD）包括中央处理单元（CPU）和耦合到CPU的可编程接口，其中可编程接口包括由用户指定的核心。 可编程接口核心允许芯片上和片外的器件与CPU通信。 在一个实施例中，可编程接口核心包括用于耦合多个设备和CPU的交叉点开关。 PLD的可重新编程在提供可根据用户需求和/或相关设计参数化的功能方面提供了极大的灵活性。 具体来说，这些参数化特征可以在PLD上的可编程资源中实现，从而允许在任何时候修改这些特征。 此外，只有实现可编程接口核心所需的资源才能实现，从而允许用户优化PLD的其余部分的使用。 最后，可以有效地限制处理器局部总线的功能，从而允许PLD接近ASIC的性能水平。
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    • 7. 发明申请
      US20060236018A1 Programmable logic device including programmable interface core and central processing unit 有权
    • Programmable logic device including programmable interface core and central processing unit
    • 可编程逻辑器件包括可编程接口核心和中央处理器
    • US20060236018A1
    • 2006-10-19
    • US11452850
    • 2006-06-14
    • Khang Dao , Glenn Baxter
    • Khang Dao , Glenn Baxter
    • G06F13/00
    • G06F15/7867
    • A programmable logic device (PLD) includes a central processing unit (CPU) and a programmable interface coupled to the CPU, wherein the programmable interface includes a core designated by a user. The programmable interface core allows devices, both on and off-chip, to communicate with the CPU. In one embodiment, the programmable interface core includes a crosspoint switch for coupling a plurality of devices and the CPU. Re-programmability of the PLD provides significant flexibility in providing features that can be parameterized based on the user's needs and/or associated design. Specifically, these parameterized features can be implemented in programmable resources on the PLD, thereby allowing these features to be modified at any time. Moreover, only those resources actually needed for the programmable interface core need be implemented, thereby allowing the user to optimize use of the remainder of the PLD. Finally, the functions of the processor local bus can be efficiently limited, thereby allowing the PLD to approach the performance level of an ASIC.
    • 可编程逻辑器件（PLD）包括中央处理单元（CPU）和耦合到CPU的可编程接口，其中可编程接口包括由用户指定的核心。 可编程接口核心允许芯片上和片外的器件与CPU通信。 在一个实施例中，可编程接口核心包括用于耦合多个设备和CPU的交叉点开关。 PLD的可重新编程在提供可根据用户需求和/或相关设计参数化的功能方面提供了极大的灵活性。 具体来说，这些参数化特征可以在PLD上的可编程资源中实现，从而允许在任何时候修改这些特征。 此外，只有实现可编程接口核心所需的资源才能实现，从而允许用户优化PLD的其余部分的使用。 最后，可以有效地限制处理器局部总线的功能，从而允许PLD接近ASIC的性能水平。
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