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    • 8. 发明专利
    • Equipo y método de procesamiento de datos
    • ES2403516T3
    • 2013-05-20
    • ES11189831
    • 2008-10-17
    • SONY CORP
    • TAYLOR MATTHEW PAUL ATHOLATUNGSIRI SAMUEL ASANBENGWILSON JOHN NICHOLAS
    • H03M13/27H04L1/00H04L5/00H04L27/00H04L27/26
    • Un equipo de procesamiento de datos que se utiliza para asignar símbolos de datos de entrada que se van acomunicar sobre un número predeterminado de señales subportadoras de símbolos Multiplexados por División deFrecuencia Ortogonal, OFDM, estando determinado el número predeterminado de señales subportadoras deacuerdo con uno de una pluralidad de modos de operación, e incluyendo los símbolos de datos de entrada unosprimeros conjuntos de símbolos de datos de entrada para ser asignados a unos primeros símbolos OFDM y unossegundos conjuntos de símbolos de datos de entrada para ser asignados a unos segundos símbolos OFDM,comprendiendo el equipo de procesamiento de datos un entrelazador (33) que se utiliza para grabar en una memoria (100) el número predeterminado de símbolos dedatos para ser asignados a las señales subportadoras OFDM, y para leer de la memoria (100) los símbolos de datospara las subportadoras OFDM con el fin de establecer la asignación, realizándose la lectura en un orden diferentedel de grabación, estando determinado dicho orden a partir de un conjunto de direcciones, de tal modo que lossímbolos de datos resultan entrelazados sobre las señales subportadoras, un generador (102) de direcciones que se utiliza para generar el conjunto de direcciones, generándose unadirección para cada uno de los símbolos de entrada con el fin de asignar los símbolos de datos de entrada a una delas señales subportadoras, comprendiendo dicho generador (102) de direccionesun registro (200) de desplazamiento con realimentación lineal que incluye un número predeterminado deposiciones de registro y que se utiliza para generar una secuencia pseudoaleatoria de bits de acuerdo con unpolinomio generador, un circuito (210) de permutación que se utiliza para recibir el contenido de las posiciones del registro dedesplazamiento y permutar el orden de los bits presentes en las posiciones del registro de acuerdo con un orden depermutación para formar una dirección de una de las subportadoras OFDM, y una unidad (224) de control que se utiliza en combinación con un circuito (216) de comprobación de direccionespara regenerar una dirección cuando una dirección generada excede una dirección válida máxima predeterminada,en donde uno de una pluralidad de modos de operación proporciona aproximadamente dieciséis mil subportadoraspor cada símbolo OFDM, proporcionando dichas aproximadamente dieciséis mil subportadoras la mitad o menos dela mitad de un número máximo de subportadoras en los símbolos OFDM de cualquiera de los modos de operación,la dirección válida máxima predeterminada es aproximadamente dieciséis mil, el registro (200) de desplazamiento con realimentación lineal dispone de trece posiciones de registro con unpolinomio generador **Fórmula**para el registro dedesplazamiento con realimentación lineal, y el orden de permutación forma, junto con un bit adicional, una direcciónde catorce bits, y el equipo de procesamiento de datos está adaptado para entrelazar los símbolos de datos deentrada tanto del primer como del segundo conjuntos de acuerdo con únicamente un proceso de entrelazamientoimpar, incluyendo el proceso de entrelazamiento impargrabar los primeros conjuntos de símbolos de datos de entrada en una primera parte (401) de la memoria (100)del entrelazador de acuerdo con un orden secuencial de los primeros conjuntos de símbolos de datos de entrada,leer los primeros conjuntos de símbolos de datos de entrada de la primera parte (401) de la memoria (100) delentrelazador y asignarlos a las señales de las subportadoras de los primeros símbolos OFDM de acuerdo con unorden definido por el conjunto de direcciones, grabar el segundo conjunto de símbolos de datos de entrada en una segunda parte de la memoria (402) delentrelazador de acuerdo con un orden secuencial de los segundos conjuntos de símbolos de datos de entrada, yleer los segundos conjuntos de símbolos de datos de entrada de la segunda parte (402) de la memoria (100) delentrelazador y asignarlos a las señales subportadoras de los segundos símbolos OFDM de acuerdo con un ordendefinido por el conjunto de direcciones.
    • 10. 发明专利
    • Data processing apparatus and method
    • GB2454318B
    • 2012-10-17
    • GB0819397
    • 2008-10-22
    • SONY CORP
    • TAYLOR MATTHEW PAUL ATHOLATUNGSIRI SAMUEL ASANBENGWILSON JOHN NICHOLAS
    • H03M13/27G06F7/58H04L27/26H04N7/24
    • A data processor maps input data symbols to be communicated onto a predetermined number of sub-carrier signals of an Orthogonal Frequency Division Multiplexed (OFDM) symbol. The data processor includes an interleaver memory which reads-in the predetermined number of data symbols for mapping onto the OFDM sub-carrier signals. The interleaver memory reads-out the data symbols on to the OFDM sub-carriers to effect the mapping, the read-out being in a different order than the read-in, the order being determined from a set of addresses, with the effect that the data symbols are interleaved on to the sub-carrier signals. The set of addresses are generated from an address generator which comprises a linear feedback shift register and a permutation circuit. A generator polynomial for the linear feedback shift register is R i ¹ 8 = R i - 1 ¹ 0 Š• R i - 1 ¹ 4 , and a permutation code is provided for permuting the order of the content of the register stages. The permutation code has been established by simulation analysis to optimise communication performance via typical radio channels. As such, a 1K operating is provided with an interleaver, which can interleave data symbols onto approximately one thousand sub-carriers of OFDM symbols for an OFDM modulated system such as a Digital Video Broadcasting (DVB) standard such as DVB-Terrestria12 (DVB-T2) or DVB-Cable2.