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    • 9. 发明申请
    • COPROCESSOR HAVING TASK SEQUENCE CONTROL
    • 具有任务序列控制的共处理器
    • US20130117533A1
    • 2013-05-09
    • US13642952
    • 2011-04-06
    • Jan Hayek
    • Jan Hayek
    • G06F15/76
    • G06F15/76G06F9/3851G06F9/3879
    • A coprocessor has: a processing unit for processing tasks in a data-processing system subject to at least one master processor; at least one storage module having memory areas, assignable in each case to the tasks, for storing data assigned to the tasks; and a buffer area for buffering instructions assigned to the tasks, the instructions including processing instructions, and upon retrieval of the processing instructions from the buffer area, the data stored in the storage module being processed on the basis of the processing instructions.
    • 协处理器具有:处理单元,用于在受至少一个主处理器的数据处理系统中处理任务; 至少一个存储模块具有存储区域,每种情况都可分配给任务,用于存储分配给任务的数据; 以及用于缓冲分配给任务的指令的缓冲区,所述指令包括处理指令,并且在从所述缓冲区检索到所述处理指令时,存储在所述存储模块中的数据正在根据所述处理指令进行处理。