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    • 4. 发明专利
    • Techniken und Verfahren für die Ratenregelung eines Anzeigedatenstroms
    • DE112011105994B4
    • 2017-04-06
    • DE112011105994
    • 2011-12-21
    • INTEL CORP
    • ANSARI NAUSHEENWITTER TODD M
    • G09G5/00G06F3/14H04L47/30H04N17/04
    • Verfahren, das Folgendes aufweist: Bestimmen, durch einen Prozessorkreis, einer Zielanzeigedatenübertragungsrate für ein oder mehrere Displays, Erzeugen, durch einen digitalen Differenzanalysator (DDA), der zur Kommunikation mit dem Prozessorkreis verbunden ist, einer aktuellen Anzeigedatenübertragungsrate für ein oder mehrere Anzeigedatenpakete basierend auf der Zielanzeigedatenübertragungsrate, wobei das Erzeugen das Bestimmen einer zugewiesenen Schlitzmenge basierend auf der Zielanzeigedatenübertragungsrate und Erzeugen der aktuellen Anzeigedatenübertragungsrate basierend auf der zugewiesenen Schlitzmenge umfasst; Übertragen des einen oder der mehreren Anzeigedatenpakete basierend auf der aktuellen Anzeigedatenübertragungsrate, wobei das Übertragen jedes des einen oder der mehreren Anzeigedatenpakete Folgendes aufweist: Addieren der zugewiesenen Schlitzmenge zu einem Ratenregelschlitzzähler und Einstellen eines DDA-Schlitzzählers auf die aktuelle Anzeigedatenübertragungsrate; Übertragen, in einer iterativen Schleife, eines nächsten Anzeigedatenelements, das innerhalb eines nächsten Anzeigedatenschlitzes in dem Anzeigedatenpaket enthalten ist, Dekrementieren eines DDA-Schlitzzählers um eins und Dekrementieren eines Ratenregelschlitzzählers um eins, bis der DDA-Schlitzzähler gleich null ist und wenn der Ratenregelschlitzzähler nicht kleiner als eins ist, iteratives Übertragen eines Ratenregeldatenelements und Dekrementieren des Ratenregelschlitzzählers um eins, bis der Ratenregelschlitzzähler kleiner als eins ist; und Ansammeln eines Unterschieds zwischen der aktuellen Anzeigedatenübertragungsrate und der Zielanzeigedatenübertragungsrate für das eine oder die mehreren Anzeigedatenpakete.