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    • 1. 发明授权
    • 동일 레벨 인터럽트 실행순서 제어방법
    • 同级别中断执行序列控制方法
    • KR100241343B1
    • 2000-02-01
    • KR1019970054293
    • 1997-10-22
    • 주식회사 케이티한국전자통신연구원
    • 김봉수이범철주범순
    • H04L29/00
    • 본 발명은 동일 레벨 처리불가 시간등록에 의한 인터럽트 실행순서 제어방법에 관한 것으로서, 주기적으로 발생하는 고실시간성 인터럽트 발생시각의 일정 시간전에 다른 동일 레벨의 인터럽트가 발생하면 이의처리를 연기하기 위해 동일레벨 인터럽트의 처리 제한시간을 나타내는 동일레벨인터럽트 처리불가 시간, 상기 특정 인터럽트가 동일레벨인터럽트 처리불가 시간등록/해제를 요구하였을 때 이의 등록/해제요구를 처리하고 인터럽트 발생시 동일레벨의 인터럽트인가를 구별하기 위한 인터럽트 서비스루틴 스터브, 동일레벨 인터럽트 처리불가 시간이 등록된 상태에서 이 제한시간 이내에 다른 동일레벨 인터럽트가 발생하면 인터럽트서비스 루틴 스터브에 의하여 곧이어 발생할 고실시간성 인터럽트의 처리후에 이 인터럽트를 처리하기 위한 작업을 저장하기 위한 인터럽트 작업 큐, 고실시간성 인터럽트 처리루틴의 등록/해제시 인터럽트번호와 동일 레벨인터럽트 처리불가시간정보를 추출하여 등록/해제를 요구하기 위한 인터럽트 서비스 루틴등록/해제프리미티브로 구성된 동일레벨을 갖는 인터럽트 실행순서를 실행함으로써, 동일레벨인터럽트들에서도 실행순서를 부여할 수 있으며, 동일레벨의 다른 인터럽트들 보다 실행의 고실시간성을 부여할수 있고, 발생한 인터럽트에 대하여 선처리할 수 있는 과정을 추가할 수 있으며, 수행의 가장 우선권을 갖는 새로운 인터럽트 작업큐를 생성하는 효과가 있다.
    • 2. 发明公开
    • 동일 레벨 인터럽트 실행순서 제어방법
    • 同级别中断执行顺序的控制方法
    • KR1019990033051A
    • 1999-05-15
    • KR1019970054293
    • 1997-10-22
    • 주식회사 케이티한국전자통신연구원
    • 김봉수이범철주범순
    • H04L29/00
    • 본 발명은 동일 레벨 처리불가 시간등록에 의한 인터럽트 실행순서 제어방법에 관한 것으로서, 주기적으로 발생하는 고실시간성 인터럽트 발생시각의 일정 시간전에 다른 동일 레벨의 인터럽트가 발생하면 이의처리를 연기하기 위해 동일레벨 인터럽트의 처리 제한시간을 나타내는 동일레벨인터럽트 처리불가 시간, 상기 특정 인터럽트가 동일레벨인터럽트 처리불가 시간등록/해제를 요구하였을 때 이의 등록/해제요구를 처리하고 인터럽트 발생시 동일레벨의 인터럽트인가를 구별하기 위한 인터럽트 서비스루틴 스터브, 동일레벨 인터럽트 처리불가 시간이 등록된 상태에서 이 제한시간 이내에 다른 동일레벨 인터럽트가 발생하면 인터럽트서비스 루틴 스터브에 의하여 곧이어 발생할 고실시간성 인터럽트의 처리후에 이 인터럽트를 처리하기 위한 작업을 저장하기 위한 인터럽트 작업 큐, 고실시간성 인터럽트 처리루틴의 등록/해제시 인터럽트번호와 동일 레벨인터럽트 처리불가시간정보를 추출하여 등록/해제를 요구하기 위한 인터럽트 서비스 루틴등록/해제프리미티브로 구성된 동일레벨을 갖는 인터럽트 실행순서를 실행함으로써, 동일레벨인터럽트들에서도 실행순서를 부여할 수 있으며, 동일레벨의 다른 인터럽트들 보다 실행의 고실시간성을 부여할수 있고, 발생한 인터럽트에 대하여 선처리할 수 있는 과정을 추가할 수 있으며, 수행의 가장 우선권을 갖는 새로운 인터럽트 작업큐를 생성하는 효과가 있다.
    • 7. 发明授权
    • 천이모드를이용한디지털위상고정루프의동기제어방법
    • 使用转换模式进行同步的数字PLL控制方法
    • KR100262945B1
    • 2000-08-01
    • KR1019970045822
    • 1997-09-04
    • 한국전자통신연구원주식회사 케이티
    • 김봉수이범철주범순
    • H03L7/08
    • PURPOSE: A synchronization controlling method is provided to prevent degradation of stability and interference between output clocks by adding an intermediate transition mode. CONSTITUTION: A free-running mode(1) maintains stability of an oscillator in a phase-locked loop. A fast mode(2) enables an output clock of the phase-locked loop to be frequency synchronized with the reference clock. A hold fast mode(3) returns to the fast mode(2) in step(15) if a frequency of the reference clock becomes within an oscillation range of an oscillator, and transits to the free-running mode(1) in step(16) if the frequency of the reference clock is out of the oscillation range. A hold normal mode(5) operates upon the frequency difference between the output clocks in step(17). A fine normal mode(6) operates upon the coincidence between the output clock of the phase-locked loop and the phase of the reference clock in step(13).
    • 目的:提供一种同步控制方法,通过添加中间过渡模式来防止输出时钟之间的稳定性和干扰的劣化。 构成:自由运行模式(1)保持振荡器在锁相环路中的稳定性。 快速模式(2)使得锁相环的输出时钟与参考时钟频率同步。 如果参考时钟的频率在振荡器的振荡范围内,保持快速模式(3)返回到步骤(15)中的快速模式(2),并且在步骤(1)中转移到自由运行模式(1) 16)如果参考时钟的频率超出振荡范围。 保持正常模式(5)在步骤(17)中根据输出时钟之间的频率差进行操作。 精细正常模式(6)在步骤(13)中根据锁相环的输出时钟与参考时钟的相位之间的一致性进行操作。
    • 8. 发明授权
    • ATM 스위치의 공통 메모리 임계 및 포화 상태 제어방법
    • KR100175573B1
    • 1999-04-01
    • KR1019960044803
    • 1996-10-09
    • 한국전자통신연구원주식회사 케이티
    • 김봉수나지하이범철
    • H04L12/933H04L12/801
    • 본 발명은 ATM(Asynchronous Transfer Mode) 기술을 적용한 스위치에서의 공통 메모리 상태를 주기적 감시 방법 및 인터럽트 처리 방식에 의하여 제어하는 방법에 관한 것으로서, 종래기술의 교환 시스템에서 입력되는 데이터는 스위치에서 교환되는 과정에서 일시 저장되는 과정 없이 미리 정해진 희선으로 데이터를 출력하였지만, 본 발명에서는 ATM을 기반으로 하는 스위치에서 입력되는 데이터를 공통 메모리의 상태에 따라 제어하기 위해, ATM스위치로 입력되는 데이터 셀을 목적하는 곳으로 라우팅하기 위하여 그 데이터 셀을 임시 저장하는 SMEA내 공통 메모리(CM)의 상태 제어방법에 있어서, 공통 메모리의 주기적 감시에 의해 임계 상태에 도달할 경우 상위 프로세서의 운용 프로세스에 과도한 셀의 송신 자제 요청을 하는 과정과; 이 요청에도 불구하고 공통 메모리가 주기적 감시에 의해 포화 상태에 도달할 경우 포화 상태 인터럽트를 발생하는 과정과; 및 그 발생된 포화 상태 인터럽트를 수신하여 공통 메모리의 포화 상태를 주기적으로 감시하여 계속 포화 상태일 경우 상위 윤용 프로세스에게 과도한 셀의 송신 금지를 요청하는 과정으로 이루어져, 공통 메모리의 상태를 제어하는 것이다.