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1. 实用新型

KR2020000018047U 전기 이중층 캐패시터용 단자 无效
标题翻译：双电层电容器
公开(公告)号：KR2020000018047U
公开(公告)日：2000-10-05
申请号：KR2019990003849
申请日：1999-03-11
申请人： 주식회사삼영에스앤씨
发明人： 김경호 , 강인수 , 오제영 , 유남산 , 이용욱 , 이상현
IPC分类号： H01G9/008
CPC分类号： Y02E60/13 , H01G11/74
摘要： 본고안은전기이중층캐패시터에서양극와음극을인출하기위해사용되는단자에관한것으로, 특히단자의형태를선형으로형성하고단위셀의접촉면에요철을형성함으로써단위셀표면과단자간의접촉면적을최소화하여단위셀과단자의용접시발생하는접촉저항의증가를방지하고, 성형단자전체를도금함으로써제조공정을단순화할 수있는전기이중층캐패시터의단자에관한것이다.

2. 发明公开

KR1020000060043A 칩형 전기 이중층 캐패시터의 제조방법 失效
标题翻译：芯片型双电层电容器及其方法
公开(公告)号：KR1020000060043A
公开(公告)日：2000-10-16
申请号：KR1019990008070
申请日：1999-03-11
申请人： 주식회사삼영에스앤씨
发明人： 김경호 , 오제영 , 유남산 , 이용욱 , 이상현 , 최수진
IPC分类号： H01G9/00
CPC分类号： Y02E60/13 , H01G11/84 , H01G11/78
摘要： PURPOSE: A chip type electric double layer capacitor is provided to prolong the length of an article's life with miniaturizing and light-weighting capacitor. CONSTITUTION: A chip type electric double layer capacitor is cased with an insulated armour and serial laminated two or three cell units(101) inside the case. A terminal(102,103) is connected to the top of the upper cell unit and to the bottom of the lower cell unit of the serial laminated cell units(101). The terminal(102,103) is bent at a right angle or vertically in lower part of the armoring case. And the terminal(102,103) is connected to the cell units(101) by welding to be used as a positive and a negative electrode. The serial laminated cell units(101) with the terminals(102,103) are put in a lower metal mold(107) having a molding gate slot(109) and a molding press guide(108), and covered with an upper metal mold(105) having a molding press guide(106) inside. The upper and the lower metal mold(105,107) are pressed and then molded by projecting a molding material through the molding gate slot(109). After removing the hardened metal molds, the protruding terminals are bent under the molding case.
摘要翻译：目的：提供一种片式双电层电容器，通过小型化和轻量化电容器延长制品的使用寿命。构成：芯片式双电层电容器采用绝缘护套和套管内的串联层叠的两个或三个电池单元（101）。端子（102,103）连接到上电池单元的顶部和连接层压电池单元（101）的下电池单元的底部。端子（102,103）在铠装壳体的下部以直角弯曲或垂直弯曲。端子102,103通过焊接与电池单元101连接，作为正极和负极使用。将具有端子（102,103）的串联层叠电池单元（101）放入具有模制门槽（109）和模压机引导件（108）的下金属模具（107）中，并被上金属模具（105）覆盖）内部具有成型压力引导件（106）。上下金属模具（105,107）被压制，然后通过模制浇口槽（109）突出模制材料来模制。在去除硬化的金属模具之后，突起端子在模制箱下弯曲。

3. 发明授权

KR100603052B1 칩형 전기 이중층 캐패시터의 제조방법 失效
标题翻译：芯片式双电层电容器方法
公开(公告)号：KR100603052B1
公开(公告)日：2006-07-24
申请号：KR1019990008070
申请日：1999-03-11
申请人： 주식회사삼영에스앤씨
发明人： 김경호 , 오제영 , 유남산 , 이용욱 , 이상현 , 최수진
IPC分类号： H01G9/00
CPC分类号： Y02E60/13
摘要： 본 발명은 칩형 전기 이중층 캐패시터에 관한 것으로, 특히 전기 이중층 캐패시터의 외장 케이스를 열경화성 수지인 에폭시 등을 이용하여 몰딩에 의해 형성함으로써 단위셀들과 단자 접촉점을 완전히 밀폐시켜 상기 캐패시터의 성능을 향상시키고, 상기 캐패시터를 소형화 및 경량화 할 수 있는 칩형 전기 이중층 캐패시터와 그 제조방법에 관한 것이다.
전기 이중층 캐패시터의 제조방법

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