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热词
    • 8. 发明公开
    • 일관성 유닛을 갖는 멀티-레벨 시스템 메모리를 위한 메모리 제어기
    • 内存控制器,用于具有相关单元的多级系统内存
    • KR1020170130390A
    • 2017-11-28
    • KR1020177023970
    • 2016-02-18
    • 인텔 코포레이션
    • 다이아먼드,이스라엘미스가브,니르아난타라만,아라빈드그린필드,즈비카
    • G06F12/0811
    • G06F12/0811
    • 멀티-레벨시스템메모리에결합하기위한인터페이스를갖는메모리제어기를포함하는장치가설명된다. 메모리제어기는또한일관성버퍼및 일관성서비스로직회로를포함한다. 일관성버퍼는그에대한판독및/또는기입요청들이수신된캐시라인들을보관하기위한것이다. 일관성서비스로직회로는인터페이스및 일관성버퍼에결합된다. 일관성서비스로직회로는, 캐시라인의또 다른버전이수정된상태에있다는것과; 메모리제어기가캐시라인에대한보류기입요청을갖는다는것 중적어도하나가참인경우, 멀티-레벨시스템메모리의더 깊은레벨로캐시라인을라이트백하기전에, 멀티-레벨시스템메모리의한 레벨(a level)로부터축출된캐시라인을일관성버퍼내의캐시라인의또 다른버전과병합하기위한것이다.
    • 描述了一种包括具有用于耦合到多级系统存储器的接口的存储器控​​制器的设备。 存储器控制器还包括相干性缓冲器和相干服务逻辑电路。 一致性缓冲区用于保持接收读取和/或写入请求的高速缓存行。 一致性服务逻辑电路耦合到接口和一致性缓冲器。 一致性服务逻辑电路还被配置为确定高速缓存行的另一版本处于修改状态; 如果存储器控制器是至少一种的,真正的具有用于高速缓存行的待处理写入请求时,所述多电平到写回高速缓存行,多一个水平上,系统存储器的水平之前在系统存储器更深的层次(水平 )在一致性缓冲区中使用另一个版本的高速缓存行。
    • 10. 发明授权
    • 스위즐된 데이터 명령/어드레스 신호들을 맵핑하는 트레이닝
    • 训练映射交换的数据命令/地址信号
    • KR101729872B1
    • 2017-04-24
    • KR1020157012168
    • 2013-06-18
    • 인텔 코포레이션
    • 코스틴스키,알렉세이그린필드,즈비카모작,크리스토퍼피.코네브,파벨포멘코,올가
    • G11C11/4072G11C7/10G11C7/20G11C29/02
    • G11C7/1072G11C7/1063G11C7/20G11C11/4072G11C29/023G11C29/028G11C2207/105G11C2207/2254
    • 데이터핀 맵핑및 지연트레이닝기법들. 메모리디바이스에서명령/어드레스(CA) 버스상의유효값들이검출된다. CA 버스상에서의값들의검출에응답하여패턴의제1 부분(하이위상)이메모리디바이스의데이터핀들의제1 서브세트를통해전송되고; CA 버스상에서의값들의검출에응답하여패턴의제2 부분(로우위상)이메모리디바이스의데이터핀들의제2 서브세트를통해전송된다. CA 패턴이전송되는동안메모리제어기에서데이터핀들로부터신호들이샘플링되어샘플링된데이터핀들의제1 및제2 서브세트를분석함으로써제1 메모리디바이스의샘플(하이위상) 및제2 메모리디바이스의샘플(로우위상)을획득한다. CA 버스상에전송된패턴에대한지식과결합된이 분석은미지의데이터핀들의맵핑을찾도록유도한다. 전송되는 CA 패턴들, 및그 결과의메모리제어기데이터신호들의샘플링된피드백들을변화시킴으로써이전의데이터핀들맵핑의지식이있든지없든지 CA/CTRL/CLK 신호들의지연트레이닝을허용한다.
    • 数据引脚映射和延迟训练技术。 检测存储器设备中命令/地址(CA)总线上的有效值。 响应于检测到所述CA总线sangeseoui值在所述第一部分(高的相)的图案的存储设备的数据引脚的第一子集发送的; 响应于检测到所述CA总线sangeseoui值的它在图案的所述存储器设备的数据引脚的所述第二部分(低相位)的第二子集发射。 通过分析信号的第一mitje第二子集中的第一存储器装置的样品从数据管脚mitje第二存储器设备的存储器控​​制器,而样品的CA图案转印(高相)(低相位)上取样的取样数据针 要获得。 该分析结合在CA总线上传输的模式的知识导致找到未知数据引脚的映射。 运输C​​A图案,无需通过改变mitgeu结果的存储器控​​制器的采样的反馈信号数据的映射的数据的先验知识销任何事项允许训练CA / CTRL / CLK信号的延迟。