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1. 发明专利

JP2015073205A PLL周波数シンセサイザ审中-公开
标题翻译： PLL频率合成器
公开(公告)号：JP2015073205A
公开(公告)日：2015-04-16
申请号：JP2013207986
申请日：2013-10-03
申请人：三菱電機株式会社
发明人：小牧昌彦
IPC分类号： H03L7/20 , H03L7/08
摘要：【課題】 PLL周波数シンセサイザにおいて、周波数分解能を高めた際に生じる位相雑音性能劣化を回避する。【解決手段】基準信号発生器からの入力信号と帰還信号の位相差を、電圧に変換して出力する位相比較器と、上記位相比較器の出力電圧にフィルタ処理を施すループフィルタと、上記ループフィルタからの入力信号の電圧に基づいて出力周波数を制御する電圧制御発振器と、上記電圧制御発振器の出力信号を整数M倍に逓倍する逓倍器と、上記逓倍器の出力信号を整数N分の1に分周し、上記位相比較器に帰還信号として出力する分周器を備える。【選択図】図1
摘要翻译：要解决的问题：提供一种PLL频率合成器，其避免了当频率分辨率增加时引起的相位噪声性能下降。解决方案：PLL频率合成器包括：相位比较器，用于转换来自参考信号发生器的输入信号以及对要输出的电压的反馈信号; 用于对相位比较器的输出电压进行滤波的环路滤波器; 压控振荡器，用于根据来自环路滤波器的输入信号的电压来控制输出频率; 用于将压控振荡器的输出信号乘以整数M的乘法器; 以及分频器，用于在将反馈信号输出到相位比较器时将乘法器的输出信号的频率除以整数N.

2. 发明专利

JP2017011077A 高周波パッケージおよび高周波半導体装置の製造方法审中-公开
标题翻译：用于产生高频组件和高频半导体器件的方法
公开(公告)号：JP2017011077A
公开(公告)日：2017-01-12
申请号：JP2015124156
申请日：2015-06-19
申请人：三菱電機株式会社
发明人：小牧昌彦
IPC分类号： H01L25/00 , H01L23/12
CPC分类号： H01L2224/32245 , H01L2224/48091 , H01L2224/48247 , H01L2224/73265 , H01L2224/92247 , H01L2924/181
摘要：【課題】ボンディングワイヤにて生じるインピーダンス不整合を回避し、低損失の高周波パッケージを得ること。【解決手段】高周波回路素子1を搭載する素子搭載部2と、高周波回路素子1にボンディングワイヤ5を介して接続される複数のリード端子3と、複数のリード端子3の端部3Tを露呈させて、高周波回路素子1およびリード端子3とを覆うパッケージ6とを備える。ボンディングワイヤ5は、高周波回路素子1とリード端子3との間で第1および第2のワイヤ部5a,5bに分離され、第1および第2のワイヤ部5a,5bの間に接続されたキャパシタ4を備える。【選択図】図1
摘要翻译：甲避免由接合线的阻抗失配，从而获得高频组件低损耗。和A元素用于安装的高频电路器件1安装部分2，多个引线端子3的经由接合线5向高频电路装置1连接，以暴露所述多个引线端子3的端部3T Te和包6覆盖高频电路装置1和引线端子3。接合线5，高频电路元件1和引线端子3之间的第一和第二线部分5a被分成5b中，第一和第二线部分5a，5b的连接之间的电容器配备有4。点域1

3. 发明专利

JP6079251B2 共振器、フィルタ、およびフィルタバンク有权
标题翻译：谐振器，滤波器和滤波器组
公开(公告)号：JP6079251B2
公开(公告)日：2017-02-15
申请号：JP2013006230
申请日：2013-01-17
申请人：三菱電機株式会社
发明人：廣田明道 , 大和田哲 , 小牧昌彦 , 佐藤綾司 , 斎藤清和
IPC分类号： H01P1/203 , H01P7/08

4. 发明专利

JP5904804B2 フェーズドアレーアンテナの校正経路測定装置有权
标题翻译：相控阵天线的校准路径测量装置
公开(公告)号：JP5904804B2
公开(公告)日：2016-04-20
申请号：JP2012012871
申请日：2012-01-25
申请人：三菱電機株式会社
发明人：高橋貴紀 , 谷口英司 , 萩原達也 , 森一富 , 小牧昌彦 , 濱野聡 , 伊藤正程
IPC分类号： H01Q3/26 , G01R29/10

5. 发明专利

JP2015171131A PLLシンセサイザ审中-公开
标题翻译： PLL合成器
公开(公告)号：JP2015171131A
公开(公告)日：2015-09-28
申请号：JP2014047280
申请日：2014-03-11
申请人：三菱電機株式会社
发明人：小牧昌彦
IPC分类号： H03L7/18 , H03L7/08 , H03L7/16
摘要：【課題】 PLLシンセサイザにおいて、周波数分解能と位相雑音性能の維持または向上を両立する。【解決手段】 2つの入力信号の位相を比較する位相検波器と、上記位相検波器の出力段に接続されたループフィルタと、上記ループフィルタの出力信号に基づいて発振周波数を制御する電圧制御発振器と、上記電圧制御発振器の出力信号を2分の1に分周する2分周器と、上記電圧制御発振器の出力信号と上記2分周器の出力信号を周波数混合するダウンコンバートミクサと、上記ダウンコンバートミクサの出力信号を分周し、上記位相検波器に一方の入力信号として入力する可変分周器とを備える。【選択図】図1
摘要翻译：要解决的问题：提供能够维持或提高频率分辨率和相位噪声性能的PLL合成器。解决方案：PLL合成器包括：用于比较两个输入信号的相位的相位检测器; 连接到相位检测器的输出级的环路滤波器; 用于根据环路滤波器的输出信号控制振荡频率的压控振荡器; 用于将压控振荡器的输出信号除以2的二分频分频器; 用于混合压控振荡器的输出信号和二分频分频器的输出信号的下变频混频器; 以及用于分割下变频混频器的输出信号并将分频信号作为相位检测器的一个输入信号的可变分频器。

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