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    • 2. 发明专利
    • 快閃型類比至數位轉換電路之比較器陣列的佈局方法 LAYOUT METHOD OF A COMPARATOR ARRAY FOR FLASH TYPE ANALOG TO DIGITAL CONVERTING CIRCUIT
    • 快闪型模拟至数码转换电路之比较器数组的布局方法 LAYOUT METHOD OF A COMPARATOR ARRAY FOR FLASH TYPE ANALOG TO DIGITAL CONVERTING CIRCUIT
    • TWI246827B
    • 2006-01-01
    • TW092129389
    • 2003-10-23
    • 三星電子股份有限公司 SAMSUNG ELECTRONICS CO., LTD.
    • 崔熙哲 CHOI, HEE-CHEOL
    • H03M
    • H03M1/365H03M1/0604
    • 本發明提供一種快閃型類比至數位轉換電路之比較器陣列的佈局方法。該快閃型類比至數位轉換電路包括一參考電壓產生器,用來產生(2n-1)個將被折疊的電壓;一比較器陣列,由(2n-1)個比較器所組成,用來比較該些各自的(2n-1)個電壓與一類比輸入訊號之間的電壓差,以產生一具有(2n-1)個位元的數位溫度計碼;以及一編碼器,用來編碼具有(2n-1)個位元的該數位溫度計碼,以產生一n位元的數位訊號。該快閃型類比至數位轉換電路之佈局方法包括:排列比較器,以使得第(2n-1)個比較器到第(2n-1)個比較器依序排列,而且第(2n/2-1)個比較器到第1個比較器會以反向方式,排列在第(2n-1)個比較器到第(2n/2)個比較器之間;以及排列比較器,以使得當第(2n-1)個比較器到第(2n/2)個比較器分別轉態成不同狀態時,鄰近於該些各自的(2n-1)個比較器的複數個鄰近比較器,會保持在相同狀態。因此不用增加佈局區尺寸,即可避免因鄰近比較器影響所造成的補償電壓增加的問題。
    • 本发明提供一种快闪型模拟至数码转换电路之比较器数组的布局方法。该快闪型模拟至数码转换电路包括一参考电压产生器,用来产生(2n-1)个将被折叠的电压;一比较器数组,由(2n-1)个比较器所组成,用来比较该些各自的(2n-1)个电压与一模拟输入信号之间的电压差,以产生一具有(2n-1)个比特的数码温度计码;以及一编码器,用来编码具有(2n-1)个比特的该数码温度计码,以产生一n比特的数码信号。该快闪型模拟至数码转换电路之布局方法包括:排列比较器,以使得第(2n-1)个比较器到第(2n-1)个比较器依序排列,而且第(2n/2-1)个比较器到第1个比较器会以反向方式,排列在第(2n-1)个比较器到第(2n/2)个比较器之间;以及排列比较器,以使得当第(2n-1)个比较器到第(2n/2)个比较器分别转态成不同状态时,邻近于该些各自的(2n-1)个比较器的复数个邻近比较器,会保持在相同状态。因此不用增加布局区尺寸,即可避免因邻近比较器影响所造成的补偿电压增加的问题。