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32. 发明专利

JP5386583B2 Cancellation of the capacitive coupling crosstalk 有权
公开(公告)号：JP5386583B2
公开(公告)日：2014-01-15
申请号：JP2011516413
申请日：2009-06-09
申请人：ラムバス・インコーポレーテッド
发明人：ウィルソン，ジョン，マイケル , ルオ，レイ
IPC分类号： H04B3/32
CPC分类号： H04B3/32 , H04L25/026

33. 发明专利

JP5285915B2 Microprocessor architecture 有权
公开(公告)号：JP5285915B2
公开(公告)日：2013-09-11
申请号：JP2007556643
申请日：2006-02-07
申请人：ラムバス・インコーポレーテッド
发明人：ウィルドマン、レオン・デイビッド
IPC分类号： G06F9/38 , G06F15/78 , G06F15/80
CPC分类号： G06F9/3885 , G06F9/30123 , G06F9/3836 , G06F9/3838 , G06F9/3851 , G06F9/3887 , G06F15/8007 , G06F15/8053

34. 发明专利

JP5220221B2 Method and apparatus for adjusting the memory operations from the memory component that has been variously placed 有权
标题翻译：空值
公开(公告)号：JP5220221B2
公开(公告)日：2013-06-26
申请号：JP2012203456
申请日：2012-09-14
申请人：ラムバス・インコーポレーテッド
发明人：フレデリック・エイ・ウェア , エリー・ケイ・ツァーン , リチャード・イー・ペレゴ , クレイグ・イー・ハンペル
IPC分类号： G06F12/00 , G06F13/16 , G06F13/40 , G06F13/42 , G11C8/00 , G11C11/401 , G11C29/00 , G11C29/02
CPC分类号： G11C11/4076 , G06F1/06 , G06F1/105 , G06F1/12 , G06F3/0604 , G06F3/0658 , G06F3/0673 , G06F13/1684 , G06F13/1689 , G06F13/1694 , G06F13/4086 , G11C5/063 , G11C7/04 , G11C7/1051 , G11C7/1072 , G11C7/1078 , G11C7/22 , G11C7/222 , G11C8/18 , G11C11/409 , G11C11/4096 , G11C29/02 , G11C29/022 , G11C29/023 , G11C29/028 , G11C29/50008 , G11C29/50012
摘要： A specific address and control bus, and a data bus (108), are connected to a memory controller (102) and a memory module (103). The data bus using differential signaling, has symbol time lesser than specific address and control bus symbol time.
摘要翻译：特定地址和控制总线以及数据总线（108）连接到存储器控制器（102）和存储器模块（103）。数据总线使用差分信号，符号时间小于特定地址和控制总线符号时间。

35. 发明专利

JP2013520759A Method and circuit for dynamically scaling the power and performance of the Dram 审中-公开
公开(公告)号：JP2013520759A
公开(公告)日：2013-06-06
申请号：JP2012553879
申请日：2010-12-01
申请人：ラムバス・インコーポレーテッド
发明人：ツェーン，イーリー , ヴォゲルサン，トーマス , ハンペル，クレイグ , ベスト，スコット，シー．
IPC分类号： G11C11/401 , G06F12/00 , G11C11/4074 , G11C11/4076
CPC分类号： G06F3/0625 , G06F1/266 , G06F3/0634 , G06F3/0673 , G11C5/147 , G11C11/4074 , G11C2207/2227
摘要：【課題】電力および性能の動的スケーリングをサポートするメモリを提供すること。
【解決手段】メモリシステムは、高性能モードおよび低電力モードをサポートする。このメモリシステムは、メモリコアおよびコアインターフェイスを含む。メモリコアは、どちらのモードでも同じままであるコア供給電圧を使用する。節電するために、コアインターフェイスの供給電圧および信号速度をスケールダウンすることができる。コアインターフェイスが異なるモードにおいて使用する信号電圧に対応するために、メモリコアとコアインターフェイスとの間のレベルシフタが信号を必要に応じてレベルシフトする。
【選択図】図１

36. 发明专利

JP2013520721A Time-division multiplexing of at a different rate to access the different memory types 有权
公开(公告)号：JP2013520721A
公开(公告)日：2013-06-06
申请号：JP2012553877
申请日：2010-11-23
申请人：ラムバス・インコーポレーテッド
发明人：シェファー，イアン
IPC分类号： G06F12/00 , G06F12/06 , G06F13/16
CPC分类号： G06F13/1694 , G06F13/287 , G06F13/3625 , G06F13/4221 , G06F13/4234
摘要：【課題】システムの性能、コスト、又は他の特徴を最適化し得ること。
【解決手段】メモリコントローラは、時分割多重化バスの使用を通して異なる固有速度で実行中の異なる種類のメモリ装置にアクセスする。データは、１種類のメモリ装置にアクセスする場合にはある速度でバスを介して転送され、別の種類のメモリ装置にアクセスする場合には異なる速度で転送される。加えて、メモリコントローラは、制御情報（例えば、コマンド及びアドレス情報）を異なる種類のメモリ装置に異なる速度で提供し得、場合によっては、制御情報を共有バス上に時間多重化し得る。
【選択図】図１

37. 发明专利

JP2013080455A Sharing check bit memory device between groups of memory devices 审中-公开
标题翻译：共享检查记忆设备组之间的位记忆设备
公开(公告)号：JP2013080455A
公开(公告)日：2013-05-02
申请号：JP2012180750
申请日：2012-08-17
申请人： Rambus Inc , ラムバス・インコーポレーテッド
发明人： THOMAS GIOVANNINI , IAN SHAEFFER
IPC分类号： G06F12/16
CPC分类号： G06F11/1044 , H03M13/09
摘要： PROBLEM TO BE SOLVED: To share a check bit memory device between groups of memory devices.SOLUTION: A memory system that supports error detection and correction (EDC) coverage. The memory system includes: a memory module with at least two groups of memory devices that store data and another memory device that stores error checking information (e.g., Error Correcting Code) for both groups of memory devices. The memory module also includes a memory buffer that determines an address for accessing the error checking information on the basis of whether data is transferred with the first group of memory devices or the second group of memory devices. Alternatively, the memory controller may determine the address for accessing the error checking information to reduce or eliminate the need for the memory buffer.
摘要翻译：要解决的问题：在存储器件组之间共享校验位存储器件。解决方案：支持错误检测和纠正（EDC）覆盖的内存系统。存储器系统包括：具有存储数据的至少两组存储器件的存储器模块和存储两组存储器件的错误检查信息（例如，错误校正代码）的另一存储器件。存储器模块还包括存储器缓冲器，其基于是否利用第一组存储器件或第二组存储器件传送数据来确定用于访问错误检查信息的地址。或者，存储器控制器可以确定用于访问错误检查信息的地址以减少或消除对存储器缓冲器的需要。版权所有（C）2013，JPO＆INPIT

38. 发明专利

JP2013502646A Atomic memory device 有权
公开(公告)号：JP2013502646A
公开(公告)日：2013-01-24
申请号：JP2012525545
申请日：2010-06-17
申请人：ラムバス・インコーポレーテッド
发明人：シェフラー，トーマス , ライ，ローレンス , ペン，リャン , リフリーク，ボフスロフ
IPC分类号： G06F12/00
CPC分类号： G06F12/023 , G06F2212/2024 , G11C7/1006 , G11C7/1039 , G11C7/22 , G11C8/10 , G11C2207/107
摘要：【課題】改善されたデータ処理システム内のデータ記憶および操作を提供することである。
【解決手段】メモリコアを有する集積回路メモリ装置において、第１のデータ値が、メモリアクセスコマンドに応じて、メモリコア内のアドレス指定された位置から検索される。第１のデータ値は、メモリアクセスコマンドに応じて、メモリ装置から出力され、第２のデータ値が、メモリアクセスコマンドに応じて、メモリコア内のアドレス指定された位置に記憶される。
【選択図】図１Ａ

39. 发明专利

JP5113159B2 Integrated circuit which includes a step-by-step on-die termination 有权
公开(公告)号：JP5113159B2
公开(公告)日：2013-01-09
申请号：JP2009513379
申请日：2007-05-22
申请人：ラムバス・インコーポレーテッド
发明人：スクオー，ギョン , ピー．シャエファー，イアン
IPC分类号： H03K19/0175
CPC分类号： H03K19/0005 , G06F3/0605 , G06F3/0659 , G06F3/0685 , G06F13/4086 , G11C11/401 , G11C11/4063 , G11C11/4093 , G11C11/41 , G11C11/413 , G11C11/417 , G11C11/419 , G11C16/06 , G11C16/26 , G11C16/32 , H03K19/017545
摘要： An integrated circuit device having graduated on-die termination. The integrated circuit device includes an input to receive a data signal, and first and second termination circuits. The first termination circuit includes a first load element and a first switch element to switchably couple the first load element to the data signal input. The second termination circuit includes a second load element and a second switch element to switchably couple the second load element to the data signal input.

40. 发明专利

JP5066667B2 Prediction method and apparatus for non-volatile memory 有权
公开(公告)号：JP5066667B2
公开(公告)日：2012-11-07
申请号：JP2008508837
申请日：2006-02-28
申请人：ラムバス・インコーポレーテッド
发明人：フー、カール
IPC分类号： G11C29/12 , G11C16/02 , G11C17/00
CPC分类号： G11C16/349 , G11C16/3495

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