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    • 11. 发明申请
    • TRAITEMENT D'UNE COUCHE DE GERMANIUM COLLEE A UN SUBSTRAT
    • 处理粘结到基材上的锗层
    • WO2007045759A1
    • 2007-04-26
    • PCT/FR2006/002332
    • 2006-10-17
    • S.O.I. TEC SILICON ON INSULATOR TECHNOLOGIESALLIBERT, FrédéricDEGUET, ChrystelRICHTARCH, Claire
    • ALLIBERT, FrédéricDEGUET, ChrystelRICHTARCH, Claire
    • H01L21/762
    • H01L21/76254
    • L'invention concerne un procédé de traitement d'une structure comprenant une couche mince de Ge sur un substrat, ladite couche ayant été préalablement collée au substrat, le procédé comprenant un traitement pour améliorer les propriétés électriques de la couche et/ou de l'interface de la couche de Ge avec la couche sous-jacente, caractérisé en ce que ledit traitement est un traitement thermique mis en œuvre à une température comprise entre 5000C et 6000C pendant au maximum 3 heures. L'invention concerne aussi un procédé de réalisation d'une structure comprenant une couche de Ge, le procédé comprenant un collage entre un substrat donneur comportant au moins dans sa partie supérieure une couche mince de Ge et un substrat récepteur, caractérisé en ce qu'il comprend les étapes suivantes : (a) collage du substrat donneur au substrat récepteur de sorte que la couche de Ge se trouve au voisinage de l'interface de collage ; (b) retrait de la partie du substrat donneur ne comprenant pas la couche de Ge ; (c) traitement de la structure comprenant le substrat récepteur et la couche de Ge conformément audit procédé de traitement.
    • 本发明涉及一种用于处理在衬底上包括薄Ge层的结构的方法,所述层已经预先结合到衬底上,该方法包括用于改善Ge层和/或Ge界面的电性能的处理 层与底层。 本发明的特征在于,所述处理是在500℃至600℃之间的温度下实施最多3小时的热处理。 本发明还涉及一种用于制造包括Ge层的结构的方法,所述方法包括将包括至少在其上部的薄Ge层和接收衬底的施主衬底结合,其特征在于,其包括以下步骤:(a) 将施主衬底接合到接收器衬底,使得Ge层位于接合界面附近; (b)消除不包括Ge层的供体衬底的一部分; (c)根据处理方法处理包括接收器基板和Ge层的结构。
    • 17. 发明公开
    • Procede d'elaboration de nanostructures ordonnées
    • 维尔法恩·祖尔·贝贝特恩·冯·戈登奈恩(Nelsonstrukturen)
    • EP1803683A1
    • 2007-07-04
    • EP06127034.4
    • 2006-12-22
    • COMMISSARIAT A L'ENERGIE ATOMIQUE
    • FOURNEL, FrankMORICEAU, HubertDEGUET, Chrystel
    • B81C1/00H01L21/18H01L21/306
    • H01L21/2007B81C1/00031H01L21/76254
    • Procédé d'élaboration de nanostructures comportant :
      -une étape de fourniture d'un substrat (100) présentant une couche d'arrêt (2) enterrée et au-dessus de cette couche d'arrêt (2) un film cristallin (5) doté d'un réseau de défauts cristallins et/ou de champs de contraintes (12) dans une zone cristalline (13),
      - une ou plusieurs étapes d'attaque du substrat (100), dont une attaque préférentielle soit des défauts cristallins et/ou des champs de contraintes, soit de la zone cristalline (13) entre les défauts cristallins et/ou les champs de contraintes, ces étapes d'attaque permettant de mettre à nu localement la couche d'arrêt (2) et de réaliser des saillies (7) à l'échelle nanométrique, séparées les unes des autres par des creux (7.1) ayant un fond situé dans la couche d'arrêt, les saillies conduisant aux nanostructures (7, 8).
    • 用于产生测序的纳米结构的步骤包括在低于一微米厚的结晶薄膜的下方提供具有阻挡层(2)的衬底(2),在结晶区域内具有晶格缺陷和/或应力场并使其经受一个或多个 更多的攻击阶段 攻击阶段局部暴露阻挡层,并在纳米尺度上产生突起(7),由凹槽(7.1)与阻挡层中的基底分开形成纳米结构(7,8)。 如果需要,可以通过雕刻阻挡层来增加纳米结构的高度,在该过程中突起作为掩模。