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세라믹 다층 커패시터
基本信息:
摘要：
본 발명은 세라믹 다층 커패시터(1)에 관한 것으로, 세라믹 다층 커패시터는 층 스택 방향(S)을 따라 하나의 스택이 되도록 배치된 세라믹 층들(3) 및 세라믹 층들(3) 사이에 배치된 제1 및 제2 전극층들(41, 42)을 포함한다. 다층 커패시터(1)는 기본 몸체(2)의 제1 측면(61)에 배치되어 제1 전극층들(41)과 전기 전도 연결된 제1 외부 콘택(51) 및 제1 측면(61)에 대향된 기본 몸체(2)의 제2 측면(62)에 배치되어 제2 전극층들(42)과 전기 전도 연결된 제2 외부 콘택(52)을 더 포함한다. 기본 몸체(2)는 층 스택 방향(S)을 따라 폭(B)을 가지고, 제1 측면(61)에 대해 수직으로 높이(H)를 가지고, 높이(H)에 대해 수직이고 층 스택 방향(S)에 대해 수직으로 길이(L)를 가지며, 폭(B) 대 높이(H)의 비율을 위해 B/H ≥ 0.2인 관계식이 적용된다.
摘要（英）：

The present invention, multilayer ceramic capacitor is disposed between the ceramic layers 3 and the ceramic layers (3) arranged such that one stack along the stack direction (S) of claim 1 and relates to a multilayer ceramic capacitor (1) It includes the first electrode layer (41, 42). The basic opposed to the multilayer capacitor 1 includes a base body 2, the first side surfaces are arranged in the 61 first electrode 41 and the electrically conductive first outer contact 51 and the first side 61 is connected to the is disposed on the second side 62 of the body 2 further includes a second electrode layer (42) and electrically conductive connected to the second external contact 52. Basic body (2) is perpendicular to a layer stack direction relative to have a width (B) along a stack direction (S), a first side 61, a height (H) perpendicular to have a height (H) for the ( S) the B / H ≥ 0.2 the relationship is applied to the vertical has a length (L), for a ratio of the width (B) to height (H) about.

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