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    • 1. 发明授权
      US07840744B2 Rank select operation between an XIO interface and a double data rate interface 失效
    • Rank select operation between an XIO interface and a double data rate interface
    • XIO接口和双数据速率接口之间的等级选择操作
    • US07840744B2
    • 2010-11-23
    • US11668725
    • 2007-01-30
    • Mark David Bellows , Kent Harold Haselhorst , John David Irish , David Alan Norgaard
    • Mark David Bellows , Kent Harold Haselhorst , John David Irish , David Alan Norgaard
    • G06F12/00
    • G06F13/1694
    • In an aspect, a first method of interfacing a processor and memory is provided. The first method includes the steps of (1) generating a first command and associated address of a first type that does not indicate a rank of memory targeted by the first command; (2) determining whether the memory includes a plurality of ranks; (3) if the memory includes a plurality of ranks, employing the processor to update the address associated with the first command to indicate a memory rank targeted by the first command; (4) if the memory does not include a plurality of ranks, employing the processor to update the address associated with the first command to indicate the memory does not include a plurality of ranks; and (5) converting the first command and associated updated address to a second command and associated address that are employed to access the memory. Numerous other aspects are provided.
    • 在一方面，提供了一种接口处理器和存储器的第一种方法。 第一种方法包括以下步骤：（1）生成不指示由第一命令指定的存储器的等级的第一类型的第一命令和相关联的地址; （2）确定存储器是否包括多个等级; （3）如果所述存储器包括多个等级，则使用所述处理器来更新与所述第一命令相关联的地址以指示由所述第一命令所针对的存储器级; （4）如果存储器不包括多个等级，则使用处理器来更新与第一命令相关联的地址以指示存储器不包括多个等级; 和（5）将第一命令和相关联的更新地址转换为用于访问存储器的第二命令和相关联的地址。 提供了许多其他方面。
    • 基本信息 添加关注 加入工作空间 PDF全文 PDF下载 全文下载 相似专利 双屏查看 权利要求书 说明书全文 Espacenet 法律信息 同族专利 专利引用
    • 4. 发明申请
      US20080183985A1 Rank Select Operation Between an XIO Interface and a Double Data Rate Interface 失效
    • Rank Select Operation Between an XIO Interface and a Double Data Rate Interface
    • 等级选择XIO接口和双数据速率接口之间的操作
    • US20080183985A1
    • 2008-07-31
    • US11668725
    • 2007-01-30
    • Mark David Bellows , Kent Harold Haselhorst , John David Irish , David Alan Norgaard
    • Mark David Bellows , Kent Harold Haselhorst , John David Irish , David Alan Norgaard
    • G06F12/00
    • G06F13/1694
    • In an aspect, a first method of interfacing a processor and memory is provided. The first method includes the steps of (1) generating a first command and associated address of a first type that does not indicate a rank of memory targeted by the first command; (2) determining whether the memory includes a plurality of ranks; (3) if the memory includes a plurality of ranks, employing the processor to update the address associated with the first command to indicate a memory rank targeted by the first command; (4) if the memory does not include a plurality of ranks, employing the processor to update the address associated with the first command to indicate the memory does not include a plurality of ranks; and (5) converting the first command and associated updated address to a second command and associated address that are employed to access the memory. Numerous other aspects are provided.
    • 在一方面，提供了一种接口处理器和存储器的第一种方法。 第一种方法包括以下步骤：（1）生成不指示由第一命令指定的存储器的等级的第一类型的第一命令和相关联的地址; （2）确定存储器是否包括多个等级; （3）如果所述存储器包括多个等级，则使用所述处理器来更新与所述第一命令相关联的地址以指示由所述第一命令所针对的存储器级; （4）如果存储器不包括多个等级，则使用处理器来更新与第一命令相关联的地址以指示存储器不包括多个等级; 和（5）将第一命令和相关联的更新地址转换为用于访问存储器的第二命令和相关联的地址。 提供了许多其他方面。
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    • 9. 发明授权
      US07660908B2 Implementing virtual packet storage via packet work area 有权
    • Implementing virtual packet storage via packet work area
    • 通过数据包工作区实现虚拟数据包存储
    • US07660908B2
    • 2010-02-09
    • US10427886
    • 2003-05-01
    • Kent Harold Haselhorst , Kerry Christopher Imming , John David Irish
    • Kent Harold Haselhorst , Kerry Christopher Imming , John David Irish
    • G06F15/167 , G06F15/173 , G06F12/00
    • H04L49/9047 , H04L49/90 , H04L49/901 , H04L69/12
    • A method, apparatus and computer program product are provided for implementing virtual packet storage via packet work area (PWA) in a network processor system. A mapping area including a packet work area and a corresponding set of packet segment registers (PSRs) are provided. A PSR is loaded with a Packet ID (PID) and a packet translation unit maps the packet data into the corresponding PWA. The PWA address defining an offset into the packet is translated into a physical address. The packet translation unit redirects loads and stores of the PWA into the correct data buffer or buffers in system memory. Packets include one or more data buffers that are chained together, using a buffer descriptor providing the packet physical address. The buffer descriptor points to a data buffer for the packet and to a next buffer descriptor.
    • 提供了一种用于通过网络处理器系统中的分组工作区（PWA）实现虚拟分组存储的方法，装置和计算机程序产品。 提供了包括分组工作区域和相应的分组段寄存器（PSR）集合的映射区域。 PSR装载有分组ID（PID），分组转换单元将分组数据映射到对应的PWA中。 定义到分组中的偏移的PWA地址被转换成物理地址。 分组转换单元将PWA的加载和存储重定向到系统存储器中的正确的数据缓冲器或缓冲器。 数据包包括使用提供数据包物理地址的缓冲区描述符链接在一起的一个或多个数据缓冲区。 缓冲区描述符指向数据包的数据缓冲区和下一个缓冲区描述符。
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