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    • 5. 发明专利
    • 兩階段式子區間ADC架構 TWO-STEP SUBRANGING ADC ARCHITECTURE
    • 两阶段式子区间ADC架构 TWO-STEP SUBRANGING ADC ARCHITECTURE
    • TW201115927A
    • 2011-05-01
    • TW099101532
    • 2010-01-20
    • 邁威爾世界貿易有限公司
    • 鄔 肯尼士 泰新魯 皮爾堤劉雄
    • H03M
    • H03M1/14H03M1/06H03M1/1014H03M1/124H03M1/167H03M1/36
    • 第一以及第二追蹤與保持階追蹤以及儲存類比輸入訊號之樣本的輸入電壓。粗略參考梯提供複數個粗略參考。在一實施例中,粗略參考梯包括第一粗略參考以及第二粗略參考梯。粗略ADC執行輸入電壓與複數個粗略參考的第一比較,以及基於第一比較輸出粗略輸出。開關矩陣包括複數個開關,且被配置以基於粗略輸出關閉相應於粗略參考的開關。精細參考梯提供複數個精細參考。精細ADC執行輸入電壓與複數個精細參考的第二比較,以及基於第二比較輸出精細輸出。邏輯基於粗略輸出以及精細輸出輸出該類比輸入訊號之樣本的數位輸出。
    • 第一以及第二追踪与保持阶追踪以及存储模拟输入信号之样本的输入电压。粗略参考梯提供复数个粗略参考。在一实施例中,粗略参考梯包括第一粗略参考以及第二粗略参考梯。粗略ADC运行输入电压与复数个粗略参考的第一比较,以及基于第一比较输出粗略输出。开关矩阵包括复数个开关,且被配置以基于粗略输出关闭相应于粗略参考的开关。精细参考梯提供复数个精细参考。精细ADC运行输入电压与复数个精细参考的第二比较,以及基于第二比较输出精细输出。逻辑基于粗略输出以及精细输出输出该模拟输入信号之样本的数码输出。
    • 7. 发明专利
    • 類比/數位轉換器 A/D CONVERTER
    • 模拟/数码转换器 A/D CONVERTER
    • TW200419918A
    • 2004-10-01
    • TW093108069
    • 2004-03-25
    • 羅姆股份有限公司 ROHM CO., LTD.
    • 本忠之 SAKAMOTO, TADAYUKI
    • H03M
    • H03M1/14H03M1/365
    • 本發明之目的係在於提供一種串並聯型類比/數位(A/D)轉換器,不需增設高精度下位位元用比較器,即能防止上位位元與下位位元轉換之比較動作上的誤動作,並降低消耗電流。其解決手段為於串並聯動作的A/D轉換器中,將上位位元數取較全位元數的一半還多,將下位位元數取全位元數的一半,而獲得上位及下位位元數據。然後,於上位及下位位元數據未取得匹配的情況時,藉下位位元數據來修正上位位元數據。
    • 本发明之目的系在于提供一种串并联型模拟/数码(A/D)转换器,不需增设高精度下位比特用比较器,即能防止上位比特与下位比特转换之比较动作上的误动作,并降低消耗电流。其解决手段为于串并联动作的A/D转换器中,将上位比特数取较全比特数的一半还多,将下位比特数取全比特数的一半,而获得上位及下位比特数据。然后,于上位及下位比特数据未取得匹配的情况时,藉下位比特数据来修正上位比特数据。