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2. 发明专利

TW201115927A 兩階段式子區間ＡＤＣ架構 TWO-STEP SUBRANGING ADC ARCHITECTURE 审中-公开
简体标题：两阶段式子区间ＡＤＣ架构 TWO-STEP SUBRANGING ADC ARCHITECTURE
公开(公告)号：TW201115927A
公开(公告)日：2011-05-01
申请号：TW099101532
申请日：2010-01-20
申请人：邁威爾世界貿易有限公司
发明人：鄔肯尼士泰新 , 魯皮爾堤 , 劉雄
IPC分类号： H03M
CPC分类号： H03M1/14 , H03M1/06 , H03M1/1014 , H03M1/124 , H03M1/167 , H03M1/36
摘要：第一以及第二追蹤與保持階追蹤以及儲存類比輸入訊號之樣本的輸入電壓。粗略參考梯提供複數個粗略參考。在一實施例中,粗略參考梯包括第一粗略參考以及第二粗略參考梯。粗略ADC執行輸入電壓與複數個粗略參考的第一比較,以及基於第一比較輸出粗略輸出。開關矩陣包括複數個開關,且被配置以基於粗略輸出關閉相應於粗略參考的開關。精細參考梯提供複數個精細參考。精細ADC執行輸入電壓與複數個精細參考的第二比較,以及基於第二比較輸出精細輸出。邏輯基於粗略輸出以及精細輸出輸出該類比輸入訊號之樣本的數位輸出。
简体摘要：第一以及第二追踪与保持阶追踪以及存储模拟输入信号之样本的输入电压。粗略参考梯提供复数个粗略参考。在一实施例中,粗略参考梯包括第一粗略参考以及第二粗略参考梯。粗略ADC运行输入电压与复数个粗略参考的第一比较,以及基于第一比较输出粗略输出。开关矩阵包括复数个开关,且被配置以基于粗略输出关闭相应于粗略参考的开关。精细参考梯提供复数个精细参考。精细ADC运行输入电压与复数个精细参考的第二比较,以及基于第二比较输出精细输出。逻辑基于粗略输出以及精细输出输出该模拟输入信号之样本的数码输出。

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