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1. 发明专利

TW201705005A 積體電路之輸入及輸出（一）审中-公开
简体标题：集成电路之输入及输出（一）
公开(公告)号：TW201705005A
公开(公告)日：2017-02-01
申请号：TW105118584
申请日：2016-06-14
申请人：諾迪克半導體股份有限公司 , NORDIC SEMICONDUCTOR ASA
发明人：陸斯登喬哈爾O , RUSTEN, JOAR OLAI , 安布爾羅爾夫 , AMBUHL, ROLF
IPC分类号： G06F13/14
CPC分类号： G06F3/0659 , G06F1/3215 , G06F1/3243 , G06F3/0611 , G06F3/0679 , G06F13/16 , G06F13/24 , G06F13/4068 , Y02D10/14
摘要：一積體電路微處理器裝置包含一中央處理單元(CPU)及具有多個外部接頭的一通用輸入或輸出模組。該等外部接頭係藉該通用輸入或輸出模組組配來提供個別輸入至該裝置。該裝置進一步包含對應該等外部接頭中之各者的個別記憶體位置。該等記憶體位置係經配置來萬一發生一狀態的改變，當該中央處理單元係在一低功率態或否則無法對該狀態的改變起回應時，將該狀態的改變紀錄在該等外部接頭中之一或多者上。
简体摘要：一集成电路微处理器设备包含一中央处理单元(CPU)及具有多个外部接头的一通用输入或输出模块。该等外部接头系藉该通用输入或输出模块组配来提供个别输入至该设备。该设备进一步包含对应该等外部接头中之各者的个别内存位置。该等内存位置系经配置来万一发生一状态的改变，当该中央处理单元系在一低功率态或否则无法对该状态的改变起回应时，将该状态的改变纪录在该等外部接头中之一或多者上。

2. 发明专利

TW201710839A 硬體周邊解碼器审中-公开
简体标题：硬件周边译码器
公开(公告)号：TW201710839A
公开(公告)日：2017-03-16
申请号：TW105118385
申请日：2016-06-13
申请人：諾迪克半導體股份有限公司 , NORDIC SEMICONDUCTOR ASA
发明人：安布爾羅爾夫 , AMBUHL, ROLF
IPC分类号： G06F3/03 , G06F3/0354 , G06F3/0362 , G06F3/038
CPC分类号： G06F3/0354 , G06F3/0312 , G06F3/03543 , G06F3/0362 , G06F3/0383
摘要：一種積體電路包含有：至少兩個輸入；以及一解碼器，其係布置來：在一第一週期內取樣該等輸入；在一第二、後面週期內取樣該等輸入；若該等經取樣輸入中僅一個輸入從該第一週期至該第二週期有變化，則更改一第一記憶體位置；以及若該等經取樣輸入兩者從該第一週期至該第二週期都有變化，則更改一第二記憶體位置。
简体摘要：一种集成电路包含有：至少两个输入；以及一译码器，其系布置来：在一第一周期内采样该等输入；在一第二、后面周期内采样该等输入；若该等经采样输入中仅一个输入从该第一周期至该第二周期有变化，则更改一第一内存位置；以及若该等经采样输入两者从该第一周期至该第二周期都有变化，则更改一第二内存位置。

3. 发明专利

TW201705006A 積體電路之輸入及輸出（二）审中-公开
简体标题：集成电路之输入及输出（二）
公开(公告)号：TW201705006A
公开(公告)日：2017-02-01
申请号：TW105118588
申请日：2016-06-14
申请人：諾迪克半導體股份有限公司 , NORDIC SEMICONDUCTOR ASA
发明人：安布爾羅爾夫 , AMBUHL, ROLF
IPC分类号： G06F13/14
CPC分类号： G06F13/26 , G06F13/20 , H01L24/18 , H01L2924/1432
摘要：一積體電路微處理器裝置包含一中央處理單元(CPU)及具有至少一個外部接頭的一通用輸入或輸出子系統。該外部接頭係經組配以取決於該通用輸入或輸出子系統中之一相關聯的設定而提供至該裝置的一輸入或提供自該裝置的一輸出。在該裝置上的至少又一個模組係經組配而能夠請求可控制該外部接頭的一狀態的至少一第一或一第二工作，該通用輸入或輸出子系統係經組配，當接收到針對該第一及第二工作之衝突請求時，施加一預定順位來允許該等工作中只有一者被施加至該外部接頭。
简体摘要：一集成电路微处理器设备包含一中央处理单元(CPU)及具有至少一个外部接头的一通用输入或输出子系统。该外部接头系经组配以取决于该通用输入或输出子系统中之一相关联的设置而提供至该设备的一输入或提供自该设备的一输出。在该设备上的至少又一个模块系经组配而能够请求可控制该外部接头的一状态的至少一第一或一第二工作，该通用输入或输出子系统系经组配，当接收到针对该第一及第二工作之冲突请求时，施加一预定顺位来允许该等工作中只有一者被施加至该外部接头。

4. 发明专利

TW201704921A 波形產生技術审中-公开
简体标题：波形产生技术
公开(公告)号：TW201704921A
公开(公告)日：2017-02-01
申请号：TW105118582
申请日：2016-06-14
申请人：諾迪克半導體股份有限公司 , NORDIC SEMICONDUCTOR ASA
发明人：安布爾羅爾夫 , AMBUHL, ROLF , 巴肯愛德蒙K , BAKKEN, VEMUND KVAL , 法格海姆弗瑞德里克J , FAGERHEIM, FREDRIK JAKOBSEN
IPC分类号： G06F1/04 , H03K7/08
CPC分类号： G06F1/025 , G06F1/022 , G06F3/0628 , H03K7/08
摘要：一數位微處理器裝置，其具有：一中央處理單元；一記憶體；以及一輸出信號模組。該輸出信號模組包含：配置來計數到一預定計數值的一計數器；以及配置來在該計數器達到一預定比較器數值時將一輸出信號從一第一輸出狀態改變至一第二輸出狀態的至少一比較器；該輸出信號模組係配置來從該記憶體自動地載入選擇自包含下列之群組的至少一參數：該預定計數值、該預定比較器數值以及該第一輸出狀態或該第二輸出狀態，而不用接收來自該中央處理單元的一指令。
简体摘要：一数码微处理器设备，其具有：一中央处理单元；一内存；以及一输出信号模块。该输出信号模块包含：配置来计数到一预定计数值的一计数器；以及配置来在该计数器达到一预定比较器数值时将一输出信号从一第一输出状态改变至一第二输出状态的至少一比较器；该输出信号模块系配置来从该内存自动地加载选择自包含下列之群组的至少一参数：该预定计数值、该预定比较器数值以及该第一输出状态或该第二输出状态，而不用接收来自该中央处理单元的一指令。

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