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1. 发明专利

TW522723B 對一數位像素感測器輸出之像素加以重排的電路及方法有权
简体标题：对一数码像素传感器输出之像素加以重排的电路及方法
公开(公告)号：TW522723B
公开(公告)日：2003-03-01
申请号：TW090115484
申请日：2001-06-26
申请人：派克斯股份有限公司
发明人：歐都多拉歐露賽艾黛咪 , 鄧中翰 , 李嘉圖詹松摩塔 , 楊曉東
IPC分类号： H04N
CPC分类号： H04N5/335
摘要：一種影像感測器，包含一感測器陣列，一資料記憶體，用以儲存像素資料及一像素正規化電路。該感測器陣列具有一二維陣列像素元件並輸出數位信號作為代表一景象影之像素資料。由感測器陣列所輸出之像素資料係被安排於感測器位元排列中，及像素正規化電路重新安排像素資料成為一像素位元順序。於另一實施例中，一影像感測器包含一感測器陣列，一資料記憶體，及一像素正規化電路，所有均製作於單一積體電路中。像素正規化電路包含一或多數像素重配置電路，一格雷至二進位轉換電路，一重置減法電路，及一多重取樣正規化電路。最後，一格雷碼至二進位轉換電路係被提供用以高速轉換。
简体摘要：一种影像传感器，包含一传感器数组，一数据内存，用以存储像素数据及一像素范式电路。该传感器数组具有一二维数组像素组件并输出数码信号作为代表一景象影之像素数据。由传感器数组所输出之像素数据系被安排于传感器比特排列中，及像素范式电路重新安排像素数据成为一像素比特顺序。于另一实施例中，一影像传感器包含一传感器数组，一数据内存，及一像素范式电路，所有均制作於单一集成电路中。像素范式电路包含一或多数像素重配置电路，一格雷至二进制转换电路，一重置减法电路，及一多重采样范式电路。最后，一格雷码至二进制转换电路系被提供用以高速转换。

2. 发明专利

TW506213B 將影像擷取之曝光時間最佳化的方法及設備有权
简体标题：将影像截取之曝光时间最优化的方法及设备
公开(公告)号：TW506213B
公开(公告)日：2002-10-11
申请号：TW090108203
申请日：2001-04-16
申请人：派克斯股份有限公司
发明人：鄧中翰 , 楊曉東 , 彭希 , 歐都多拉歐露賽艾黛咪 , 李嘉圖詹松摩塔 , 魏宜韓
IPC分类号： H04N
CPC分类号： H04N5/2351 , H04N5/2353
摘要：一種於曝光時最佳化一影像感應陣列的像素區域曝光時間的方法，藉由利用一影像感應陣列之時間間距取樣，該影像感應陣列包含有諸像素，架構以產生數位影像信號。發光值係由每一數位影像信號抽出並被分析以決定是否一像素已到達最佳曝光。若一像素已到達最佳曝光，則來自此像素之次後數位影像信號將不被記錄。這保留當該像素到達其最佳曝光時，由該像素所產生之最佳數位影像信號之記錄。此基於像素的最佳曝光以選擇地終止數位影像信號之記錄的處理可以執行於個別像素或可以執行於一像素區域中。
简体摘要：一种于曝光时最优化一影像感应数组的像素区域曝光时间的方法，借由利用一影像感应数组之时间间距采样，该影像感应数组包含有诸像素，架构以产生数码影像信号。发光值系由每一数码影像信号抽出并被分析以决定是否一像素已到达最佳曝光。若一像素已到达最佳曝光，则来自此像素之次后数码影像信号将不被记录。这保留当该像素到达其最佳曝光时，由该像素所产生之最佳数码影像信号之记录。此基于像素的最佳曝光以选择地终止数码影像信号之记录的处理可以运行于个别像素或可以运行于一像素区域中。

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