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    • 92. 发明专利
    • 半導體記憶裝置
    • 半导体记忆设备
    • TW202011584A
    • 2020-03-16
    • TW107143290
    • 2018-12-03
    • 日商東芝記憶體股份有限公司TOSHIBA MEMORY CORPORATION
    • 今本哲広IMAMOTO, AKIHIRO菅原昭雄SUGAHARA, AKIO
    • H01L27/1157G11C7/10G11C7/12
    • 本發明之實施形態提供一種能夠抑制寫入動作之潛時增加之半導體記憶裝置。 實施形態之半導體記憶裝置具備:第1記憶體面及第2記憶體面,其等各自包含含有複數個記憶胞之記憶胞陣列;輸入輸出電路,其以自控制器接收要寫入至上述記憶胞陣列之資料之方式構成;以及控制電路。上述第1記憶體面進而包含:第1感測放大器電路,其電性連接於上述第1記憶體面內之上述複數個記憶胞中之第1記憶胞;及第1鎖存電路,其串聯連接於上述輸入輸出電路與上述第1感測放大器電路之間。上述控制電路構成為,當接收到指示對上述第1記憶胞之第1寫入動作之第1指令時,於伴隨上述第1寫入動作之上述第1鎖存電路之使用完成之前受理第2指令,上述第2指令指示對上述第2記憶體面內之上述複數個記憶胞中之第2記憶胞之第2寫入動作。
    • 本发明之实施形态提供一种能够抑制写入动作之潜时增加之半导体记忆设备。 实施形态之半导体记忆设备具备:第1内存面及第2内存面,其等各自包含含有复数个记忆胞之记忆胞数组;输入输出电路,其以自控制器接收要写入至上述记忆胞数组之数据之方式构成;以及控制电路。上述第1内存面进而包含:第1传感放大器电路,其电性连接于上述第1内存面内之上述复数个记忆胞中之第1记忆胞;及第1锁存电路,其串联连接于上述输入输出电路与上述第1传感放大器电路之间。上述控制电路构成为,当接收到指示对上述第1记忆胞之第1写入动作之第1指令时,于伴随上述第1写入动作之上述第1锁存电路之使用完成之前受理第2指令,上述第2指令指示对上述第2内存面内之上述复数个记忆胞中之第2记忆胞之第2写入动作。
    • 98. 发明专利
    • 記憶體胞之基於時間存取
    • 内存胞之基于时间存取
    • TW201903761A
    • 2019-01-16
    • TW107119909
    • 2018-06-08
    • 美商美光科技公司MICRON TECHNOLOGY, INC.
    • 迪 文森佐 溫伯特DI VINCENZO, UMBERTO
    • G11C7/12G11C11/22
    • 本文中描述用於一記憶體陣列中之記憶體胞之基於時間存取的方法、系統及裝置。在一讀取操作之一感測部分期間,可將一選定記憶體胞充電至一預定電壓位準。可基於在該充電開始與在選定記憶體胞達到該預定電壓位準時之間的一持續時間識別儲存於該選定記憶體胞上之一邏輯狀態。在一些實例中,時變信號可用於基於充電之該持續時間而指示該邏輯狀態。該充電之該持續時間可基於該選定記憶體胞之一極化狀態、該選定記憶體胞之一介電電荷狀態,或該選定記憶體胞之一極化狀態及一介電電荷狀態兩者。
    • 本文中描述用于一内存数组中之内存胞之基于时间存取的方法、系统及设备。在一读取操作之一传感部分期间,可将一选定内存胞充电至一预定电压位准。可基于在该充电开始与在选定内存胞达到该预定电压位准时之间的一持续时间识别存储于该选定内存胞上之一逻辑状态。在一些实例中,时变信号可用于基于充电之该持续时间而指示该逻辑状态。该充电之该持续时间可基于该选定内存胞之一极化状态、该选定内存胞之一介电电荷状态,或该选定内存胞之一极化状态及一介电电荷状态两者。