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    • 4. 发明授权
    • 시그마-델타 변조기
    • KR102317594B1
    • 2021-10-27
    • KR1020197002232
    • 2017-06-22
    • H03M3/00
    • 본발명은가변중심주파수(f0)를중심으로하는주파수대역폭을갖는아날로그입력신호를, 샘플링주파수(fs)에서의디지털출력신호로변환하는시그마-델타(ΣΔ) 변조기에관한것이다. 상기ΣΔ변조기는디지털출력신호를생성하기위한양자화기(420)와정량화노이즈를성형하기위한루프필터를포함하다. 상기루프필터는주파수(f0)를중심으로하는적어도하나의서브필터(430, 410), 및일정한노이즈성형계수들(451, 452, 453)을가진다. 상기ΣΔ변조기는튜닝가능한지연소자(455), 정규화된중심주파수(f0/fs)가일정하도록상기샘플링주파수(fs)를조정하는주파수조정기(480), 상기정규화된루프지연(td/Ts)이사전결정된범위[tmin, tmax](Ts=1/fs) 내에있도록상기양자화기및 상기튜닝가능한지연소자(455)에의해구현되는루프지연(td)을조정하기위한지연조정기(490)를더 포함한다.
    • 5. 发明授权
    • 스위칭가능한 2차 재생 경로
    • KR102302839B1
    • 2021-09-17
    • KR1020207037207
    • 2015-04-10
    • H03M1/66H03M1/70H03M1/00H03M1/68H03M1/78H03M1/08H03M3/00
    • 본개시내용의실시예들에따라, 프로세싱시스템은제 1 프로세싱경로및 제 2 프로세싱경로를포함하는복수의프로세싱경로들, 디지털-아날로그스테이지(stage) 출력부및 제어기를포함할수 있다. 제 1 프로세싱경로는디지털입력신호를제 1 중간아날로그신호로변환하기위한제 1 디지털-아날로그변환기를포함할수 있고, 제 1 디지털-아날로그변환기는고-전력상태및 저-전력상태에서동작하도록구성된다. 제 2 프로세싱경로는디지털입력신호를제 2 중간아날로그신호로변환하기위한제 2 디지털-아날로그변환기를포함할수 있다. 디지털-아날로그스테이지출력부는제 1 중간아날로그신호와제 2 중간아날로그신호의합을포함하는아날로그신호를생성하도록구성될수 있다. 제어기는디지털입력신호의크기가임계크기보다아래일때 제 1 디지털-아날로그변환기를저-전력상태에서동작하도록구성될수 있다.
    • 7. 发明授权
    • 스위칭가능한 2차 재생 경로
    • KR102197272B1
    • 2020-12-31
    • KR20167031554
    • 2015-04-10
    • H03M1/66H03M1/00H03M1/08H03M1/68H03M1/70H03M3/00
    • 본개시내용의실시예들에따라, 프로세싱시스템은제 1 프로세싱경로및 제 2 프로세싱경로를포함하는복수의프로세싱경로들, 디지털-아날로그스테이지(stage) 출력부및 제어기를포함할수 있다. 제 1 프로세싱경로는디지털입력신호를제 1 중간아날로그신호로변환하기위한제 1 디지털-아날로그변환기를포함할수 있고, 제 1 디지털-아날로그변환기는고-전력상태및 저-전력상태에서동작하도록구성된다. 제 2 프로세싱경로는디지털입력신호를제 2 중간아날로그신호로변환하기위한제 2 디지털-아날로그변환기를포함할수 있다. 디지털-아날로그스테이지출력부는제 1 중간아날로그신호와제 2 중간아날로그신호의합을포함하는아날로그신호를생성하도록구성될수 있다. 제어기는디지털입력신호의크기가임계크기보다아래일때 제 1 디지털-아날로그변환기를저-전력상태에서동작하도록구성될수 있다.