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    • 4. 发明授权
    • 스위치드 캐패시터 연산증폭기
    • 开关电容器操作放大器
    • KR101295190B1
    • 2013-08-12
    • KR1020100139376
    • 2010-12-30
    • (주)세미솔루션
    • 김지형이정원
    • H03F3/70H03K5/08
    • 본 발명은 스위치드 캐패시터 연산증폭기에 관한 것으로, 본 발명은 스위치드 캐패시터 연산증폭기의 동작을 위해 클럭(CLK)을 입력받아 클럭신호(PH1)(PH2)를 발생시키되, 상기 클럭신호(PH1)의 상승(또는 하강) 천이와 상기 클럭신호(PH2)의 하강(또는 상승) 천이를 동일 시점에 수행하여 상기 클럭신호(PH1)(PH2)가 서로 역상이 되도록 하는 클럭 발생부(800)를 포함하며, 상기 클럭 발생부(800)는 입력 클럭(CLK)을 버퍼링하도록 2개의 인버터로 이루어진 버퍼(510)와, 상기 버퍼(510)의 출력신호를 입력받아 NAND 래치를 통해 클럭신호(PH1)를 출력하는 제1 클럭발생기(520)와, 상기 버퍼(510)의 출력신호를 입력받아 NOR 래치를 통해 상기 클럭신호(PH1)와 역상인 클럭신호(PH2)를 출력하는 제2 클럭발생기(530)를 포함한다. 본 발명은 클럭 발생 시의 지연 오차를 해소시킴으로써 정확한 클럭을 생성할 수 있다.
    • 5. 发明公开
    • 스위치드 캐패시터 연산증폭기
    • 开关电容器操作放大器
    • KR1020120077430A
    • 2012-07-10
    • KR1020100139376
    • 2010-12-30
    • (주)세미솔루션
    • 김지형이정원
    • H03F3/70H03K5/08
    • H03F3/005H03F3/45475H03F3/70H03K3/0322
    • PURPOSE: A switched-capacitor operational amplifier is provided to improve a clock feedthrough of a transmission gator by generating a precise clock without overlap. CONSTITUTION: A clock generation part generates a negative phase clock signal by eliminating delay errors from an input clock. The clock generation part comprises a buffer(510), a first clock generator(520), and a second clock generator(530). The buffer comprises two inverters in order to buffer the input clock. The first clock generator outputs a high-level clock signal in the low state of the input clock. The second clock generator outputs a low-level clock signal in the low state of the input clock.
    • 目的:提供开关电容运算放大器,以通过产生精确的时钟而不重叠来改善传输定时器的时钟馈通。 构成:时钟产生部件通过消除输入时钟的延迟误差来产生负相位时钟信号。 时钟生成部分包括缓冲器(510),第一时钟发生器(520)和第二时钟发生器(530)。 缓冲器包括两个反相器,以缓冲输入时钟。 第一个时钟发生器在输入时钟的低电平状态下输出高电平时钟信号。 第二个时钟发生器在输入时钟的低电平状态下输出低电平时钟信号。