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    • 41. 发明授权
    • CRT-RSA 모듈라 지수승 알고리즘을 이용한 디지털서명 방법, 그 장치 및 이를 기록한 컴퓨터 판독가능 저장매체
    • 数字签名方法,数字签名装置采用CRT-RSA调制求幂算法和记录介质使用相同
    • KR100953715B1
    • 2010-04-19
    • KR1020080006827
    • 2008-01-22
    • 고려대학교 산학협력단
    • 김성경김태현한동국홍석희
    • H04L9/28H04L9/32
    • CRT-RSA 모듈라 지수승 알고리즘을 이용한 디지털 서명 방법, 그 장치 및 이를 기록한 컴퓨터 판독가능 저장 매체가 개시된다.
      본 발명에 따른 CRT-RSA 모듈라 지수승 알고리즘을 이용한 디지털 서명 방법은 서로 다른 소수 를 비밀키로, 를 만족하는 을 공개키로 euler totient 함수 과 서로 소인 소정의 정수 를 공개키로, 을 만족하는 를 비밀키로 이용하는 CRT-RSA 모듈라 지수승 알고리즘을 이용한 디지털 서명 방법에 있어서, 인증된 수신자에게 전송하고자 하는 메시지 , 상기 서로 다른 소수 , 상기 를 로 모듈라 연산한 , 상기 를 로 모듈라 연산한 , 상기 와 의 합인 , 상기 을 로 모듈라 연산한 및 암호화하고자 하는 송신자에 의해 선택된 랜덤한 정수 를 수신하는 단계; 상기 와 의 차에 따라 를 생성하고, 상기 메시지 에 승한 값을 상기 와 상기 정수 를 곱한 값으로 모듈러 연산하여 값을 산출하며, 상기 메시지 에 승한 값을 상기 와 상기 정수 를 곱한 값으로 모듈러 연산하여 값을 산출하는 단계; 상기 와 의 차에 따라 를 생성하고, 상기 메시지 에 승한 값을 상기 와 상기 정수 를 곱한 값으로 모듈러 연산하여 값을 산출하고, 상기 메시지 에 승한 값을 상기 와 상기 정수 를 곱한 값으로 모듈러 연산하여 값을 산출하는 단계; 상기 연산된 및 로 이루어진 제 1 데이터 쌍을 이용하여 를 생성하고, 상기 연산된 및 로 이루어진 제 2 데이터 쌍을 이용하여 를 생성하는 단계; 상기 의 비트 길이인 와 모듈러 의 비트 길이에 따라 생성되는 제 1 출력값과, 와 의 합에 상기 의 보수 를 제 1 논리 연산을 수행한 제 2 출력값을 합하여 제 1 총합값을 생성하고, 상기 메시지 과 를 곱한 값을 으로 모듈라 연산하여 제 3 출력값을 생성하여, 상기 제 1 총합값과 제 3 출력값을 입력으로 제 2 논리 연산을 수행하여 논리합 연산의 결과값을 생성하는 단계; 및 상기 논리합 연산의 결과값과 상기 의 동일 여부에 따라 서명 인증값을 생성하는 단계를 포함한다.
      본 발명에 의하면, 단순한 레지스터의 추가에 의해 단순한 암호화 방법을 제공하며, 연산량 역시 종래의 암호화 방법에 비해 증가하지 않으면서도 최근 제시된 새로운 단순 전력 분석 및 오류 주입 공격에 안전성을 제공함으로써 스마트카드와 같은 내장형 장치에서도 효율적이고 안전한 디지털 서명 기법을 제공할 수 있는 효과가 있다.
    • 43. 发明公开
    • 다항식 기저 기반의 유한체 직렬 곱셈 장치 및 방법
    • 串行设备和使用多项式基础的有限域多项式的方法
    • KR1020090090219A
    • 2009-08-25
    • KR1020080015541
    • 2008-02-20
    • 고려대학교 산학협력단
    • 홍석희임종인김창한장남수김태현김용훈
    • G06F7/52
    • G06F7/724G06F7/525G06F7/722
    • A finite field serial multiplication apparatus based on a polynomial basis and a method thereof are provided to improve time and space complexity. The first multiplication and modular operation unit(600) performs a multiplication and modular operation of a multiplicand with a coefficient of the second multiplier. The first register(710) stores the first operation result of the first multiplication and modular operation unit. The second multiplication and modular operation unit(620) generates the second operation result by performing a multiplication and modular operation of a term excepted from the first multiplier by a trinomial irreducible polynomial expression with the coefficient of the multiplicand. The second register(720) stores an operation result of the second multiplication and modular operation unit.
    • 提供了一种基于多项式基础的有限域串行乘法装置及其方法,以提高时间和空间复杂度。 第一乘法运算单元(600)利用第二乘法器的系数进行乘法运算和乘法运算。 第一寄存器(710)存储第一乘法运算单元和模块运算单元的第一运算结果。 第二乘法运算单元(620)通过利用被乘数的三项式不可约多项式表达式,对除第一乘法器以外的项进行乘法运算和模运算,生成第二运算结果。 第二寄存器(720)存储第二乘法运算单元和运算单元的运算结果。
    • 44. 发明公开
    • 아리아 마스킹 방법 및 이를 이용한 아리아 암호 장치 및방법
    • ARIA的掩蔽方法和ARIA加密设备及其使用方法
    • KR1020090079664A
    • 2009-07-22
    • KR1020080005799
    • 2008-01-18
    • 고려대학교 산학협력단
    • 김희석김태현한동국홍석희
    • G06F9/06G06F7/00
    • H04L9/0631H04L2209/046H04L2209/24
    • An ARIA masking method, and an ARIA encryption encoding and method using the same are provided to reduce a computation time for ARIA hardware resources and an ARIA password. A controller(310) generates a masking random number and generates masking S-box of 4 kinds by the making random number and S-box of 2 kinds. An input data masking unit(340) performs the masking of input data by the masking random number to generate masked input data. A key scheduling unit(330) produces a masking round key masked from an encoding key which is input from outside with the masking random number. A masking password computation unit(350) performs each round operation for the masking input data by using the masking S-box of four kinds and the masking round key.
    • 提供ARIA屏蔽方法和使用其的ARIA加密编码和方法来减少ARIA硬件资源和ARIA密码的计算时间。 控制器(310)通过制作随机数和2种S盒来生成掩蔽随机数并产生4种掩蔽S盒。 输入数据屏蔽单元(340)通过屏蔽随机数执行输入数据的掩蔽以产生被屏蔽的输入数据。 密钥调度单元(330)产生从外部输入的掩码随机数掩码的掩码循环密钥。 掩蔽密码计算单元(350)通过使用四种屏蔽S盒和掩蔽轮密钥对掩蔽输入数据进行每轮循环操作。