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    • 5. 发明专利
    • 半導体装置
    • 半导体设备
    • JP2017045874A
    • 2017-03-02
    • JP2015167612
    • 2015-08-27
    • 株式会社東芝
    • 高橋 仁
    • H01L29/78H01L29/739
    • H01L29/7397H01L29/0623H01L29/0696H01L29/1095H01L29/407H01L29/41708H01L29/4236H01L29/7396H01L29/7811H01L29/7813
    • 【課題】オン電圧の上昇を抑制できる半導体装置を提供する。 【解決手段】第1導電形の第1半導体領域1と、第2導電形の第2半導体領域3と、第2導電形の第3半導体領域6と、第1導電形の第4半導体領域4と、第2導電形の第5半導体領域5と、ゲート電極10と、第1電極20と、を有する。第3半導体領域6は、第1絶縁層21とゲート絶縁層11との間の一部に設けられている。第3半導体領域6は、第1絶縁層21に接している。第3半導体領域6の第2導電形のキャリア濃度は、第2半導体領域3の第2導電形のキャリア濃度よりも高い。第4半導体領域4は、第1部分4aを有する。第1部分4aは、第1半導体領域4から第2半導体領域3に向かう第1方向において、第3半導体領域6と並んでいる。第5半導体領域5は、ゲート絶縁層11に接している。第5半導体領域5は、第1方向に対して垂直な第2方向において第1部分4aと並んでいる。 【選択図】図1
    • 一种半导体装置的增大导通电压可以被抑制。 和第一导电类型,第二导电类型的第二半导体区3中,第二导电类型的第三半导体区域6中,第一导电类型的第四半导体区域4的第一半导体区1 如果具有第二导电类型的第五半导体区域5,栅极电极10,和第一电极20,一个。 第三半导体区域6设置在第一绝缘层21和栅极绝缘层11之间的部分。 第三半导体区6是在与第一绝缘层21接触。 第二导电类型的第三半导体区域6的载流子浓度比所述第二导电类型的第二半导体区3的载流子浓度高。 第四半导体区域4具有第一部分4a。 第一部分4a,在与所述第一半导体区域4与第二半导体区3的第一方向,与所述第三半导体区域6对准。 第五半导体区域5是在与栅极绝缘层11接触。 第五半导体区域5与垂直于所述第一方向的第二方向上的第一部分4a对准。 点域1
    • 6. 发明专利
    • 半導体装置
    • 半导体设备
    • JP2017041491A
    • 2017-02-23
    • JP2015161021
    • 2015-08-18
    • 富士電機株式会社
    • 八尾 典明
    • H01L29/739H01L29/78H01L21/8234H01L27/06H01L29/861H01L29/868H01L29/41
    • H01L29/41708H01L29/04H01L29/16H01L29/417H01L29/456H01L29/7393H01L29/861H01L27/0629
    • 【課題】コンタクト電極の端部における電流集中を緩和する。 【解決手段】半導体層と、半導体層の表面側に設けた第1トレンチ電極と、半導体層の表面側において第1トレンチ電極と対向して設けた第2トレンチ電極とを備え、第1トレンチ電極がメッシュ状に形成された半導体装置を提供する。半導体層は、第1導電型領域と、第1導電型領域と異なる導電型を有する第2導電型領域とを更に備え、第1トレンチ電極は、第1導電型領域と電気的に接続して設けられ、第2トレンチ電極は、第2導電型領域と電気的に接続して設けられていてよい。 【選択図】図1
    • 甲放松在接触电极的边缘处的电流集中。 和半导体层包括设置在所述半导体层的表面侧的第一沟槽电极,并与所述第一沟槽电极上的半导体层的表面侧的第二沟槽电极,所述第一沟槽电极 提供了形成为网眼形状的半导体器件。 所述半导体层包括第一导电型区域和具有不同于第一导电类型区域不同的导电类型的第二导电类型区,所述第一沟槽电极连接第一导电型区域和电 提供,所述第二沟槽电极,可被提供给连接第二导电类型区和电。 点域1
    • 7. 发明专利
    • 半導体装置および半導体装置の製造方法
    • 制造半导体器件的方法和半导体器件
    • JPWO2014168171A1
    • 2017-02-16
    • JP2015511280
    • 2014-04-09
    • 富士電機株式会社
    • 勇一 小野澤勇一 小野澤
    • H01L29/78H01L21/336H01L29/739
    • H01L29/7397H01L29/0611H01L29/0619H01L29/0696H01L29/0804H01L29/407H01L29/41708H01L29/66348
    • n-ドリフト層の一方の表面層に設けられたp層は、複数のトレンチ(4)によってpベース領域(5)および浮遊p領域(6)に分割されている。トレンチ(4)のpベース領域(5)側の側壁には、第1絶縁膜(8a)を介して第1ゲート電極(9a)が設けられ、浮遊p領域(6)側の側壁には、第2絶縁膜(8b)を介してシールド電極(9b)が設けられている。第1コンタクトホール(10a)に埋め込まれたコンタクトプラグを介してゲートランナー(13)に導通接続された第1ゲート電極(9a)と、第2コンタクトホール(10b)に埋め込まれたコンタクトプラグを介してエミッタ電極(11)に導通接続されたシールド電極(9b)との間には、基板おもて面からトレンチ(4)の底面に達する絶縁膜(20)が設けられている。このようにすることで、製造プロセスを短縮することができ、低損失で信頼性の高い半導体装置を提供することができる。
    • 所提供的n - 漂移层的一个表面层上P层是由多个沟槽(4)的划分为p型基区(5)和所述浮置p区域(6)。 基极区域(5)(4)中,第一栅电极(9a)的通过第一绝缘膜(图8A)中提供的沟槽的侧面构成的p侧壁,在浮置p区(6)侧的侧壁上, 屏蔽电极(图9b)通过第二绝缘膜设置(图8b)。 通过第一接触孔第一栅电极(图9A),它是通过埋在(10A)的接触插塞(13),接触插塞埋设在所述第二接触孔电连接到所述栅极流道(10b)的 之间的发射极电极(11)导电地连接到屏蔽电极(9b)的碲,设置在绝缘膜(20)从基板前表面延伸到所述沟槽的所述底表面(4)。 通过这样做,能够缩短制造过程中,有可能提供一个高度可靠的半导体器件具有低损失。
    • 10. 发明专利
    • 半導体装置
    • 半导体设备
    • JPWO2014061619A1
    • 2016-09-05
    • JP2014542125
    • 2013-10-11
    • 富士電機株式会社
    • 勇一 小野澤勇一 小野澤高橋 英紀英紀 高橋吉村 尚尚 吉村
    • H01L29/78H01L29/423H01L29/49
    • H01L29/7397H01L29/0619H01L29/1095H01L29/407H01L29/41708H01L29/42304H01L29/4236H01L29/4238H01L29/4916H01L29/66348H01L29/7811H01L29/7813
    • 第1絶縁膜の内側に、第1トレンチ(21)の一方の側壁に沿って設けられるとともに、第2トレンチ(40)の内部に設けられた第1ゲート電極(22a)と、第2絶縁膜の内側に、第1トレンチ(21)の他方の側壁に沿って設けられるとともに、第3トレンチ(50)の内部に設けられたシールド電極(22b)と、第2トレンチ(40)が延長されることによって、一部が第1ゲート電極(22a)上に設けられ、第1ゲート電極(22a)と接続されたゲートランナーと、第3トレンチ(50)が延長されることによって、一部がシールド電極(22b)上に設けられ、シールド電極(22b)と接続されたエミッタポリシリコン層(25a)と、を備えることを特徴とする半導体装置により、わずかなプロセス工程数の増加で、コスト増加、良品率の低下を抑えながら、ターンオン特性を改善した。
    • 所述第一绝缘膜的内部,连同沿着所述第一沟槽(21),设置在所述第二沟槽(40)(22a)的内部的第一栅电极,第二绝缘膜的一个侧壁设置 的内部,随着沿所述第一沟槽(21),第三沟槽(50)的内部设置一屏蔽电极的另一侧壁所提供的(22B),第二沟槽(40)延伸 通过部分被设置在所述第一栅电极(22A),并且其被连接到第一栅极电极(22a)的一个栅极流道,由第三沟槽(50)延伸时,一个部分屏蔽 所提供的电极(22b)上,连接到屏蔽电极(22B)和(25A)的发射极多晶硅层,一个半导体器件,其特征在于它包括一个,在处理步骤数目略有增加,成本增加, 同时抑制成品率的降低和改进的导通特性。